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龙图腾网恭喜无锡亚科鸿禹电子有限公司申请的专利生成式RISC-V SoC的软硬件调试方法、系统、设备及存储介质获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119272674B 。

龙图腾网通过国家知识产权局官网在2025-03-11发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411786774.1，技术领域涉及：G06F30/331；该发明授权生成式RISC-V SoC的软硬件调试方法、系统、设备及存储介质是由冯善亮设计研发完成，并于2024-12-06向国家知识产权局提交的专利申请。

本生成式RISC-V SoC的软硬件调试方法、系统、设备及存储介质在说明书摘要公布了：本申请涉及一种生成式RISC‑VSoC的软硬件调试方法、系统、设备及存储介质，涉及RISC‑VSoC领域。其中方法包括：使用Chisel构建RISC‑VSoC生成器，RISC‑VSoC生成器包括参数化的模版文件；接收自定义参数更改信息，根据自定义参数更改信息更改模版文件得到RISC‑VSoC生成文件；通过编译工具编译RISC‑VSoC生成文件，生成RISC‑VSoC的VerilogRTL代码；当接收到软件仿真的指令时，利用VerilogRTL代码搭建软件仿真环境，根据软件仿真环境创建仿真顶层文件并进行软件仿真；当接收到FPGA原型验证的指令时，利用VerilogRTL代码搭建FPGA原型验证环境，根据FPGA原型验证环境创建顶层文件并进行FPGA原型验证。本申请的技术效果是：利用已完成定义的生成器框架，用户仅需改动简单参数即可生成自定义的RISC‑VSoC，提高了设计的灵活性和效率。

本发明授权生成式RISC-V SoC的软硬件调试方法、系统、设备及存储介质在权利要求书中公布了：1.一种生成式RISC-VSoC的软硬件调试方法，其特征在于，所述方法包括：使用Chisel构建RISC-VSoC生成器，所述RISC-VSoC生成器包括参数化的模版文件；接收自定义参数更改信息，根据所述自定义参数更改信息更改所述模版文件得到RISC-VSoC生成文件；通过编译工具编译所述RISC-VSoC生成文件，生成RISC-VSoC的VerilogRTL代码；当接收到软件仿真的指令时，利用所述VerilogRTL代码搭建软件仿真环境，根据所述软件仿真环境创建仿真顶层文件并进行软件仿真；当接收到FPGA原型验证的指令时，利用所述VerilogRTL代码搭建FPGA原型验证环境，根据所述FPGA原型验证环境创建顶层文件并进行FPGA原型验证；所述根据所述软件仿真环境创建仿真顶层文件并进行软件仿真包括：根据所述软件仿真环境创建仿真顶层文件；调用仿真模型IP，所述仿真模型IP包括仿真IPVerilog定义文件；根据所述仿真顶层文件和所述仿真IPVerilog定义文件得到所需文件列表--filelist文件；调取仿真用例，根据所述仿真用例配置仿真参数调用所述filelist文件生成可执行仿真文件；将可执行仿真文件导入所述软件仿真环境，根据所述仿真参数进行仿真得到仿真结果。

如需购买、转让、实施、许可或投资类似专利技术，可联系本专利的申请人或专利权人无锡亚科鸿禹电子有限公司，其通讯地址为：214105 江苏省无锡市锡山区安镇街道丹山路66号兖矿信达大厦A1208；或者联系龙图腾网官方客服，联系龙图腾网可拨打电话0551-65771310或微信搜索“龙图腾网”。