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龙图腾网恭喜上海矢元电子股份有限公司申请的专利基于FPGA的串行总线通信在线重构方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119166584B 。

龙图腾网通过国家知识产权局官网在2025-05-02发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411391177.9，技术领域涉及：G06F15/78；该发明授权基于FPGA的串行总线通信在线重构方法是由阎文俊设计研发完成，并于2024-10-08向国家知识产权局提交的专利申请。

本基于FPGA的串行总线通信在线重构方法在说明书摘要公布了：本发明公开了基于FPGA的串行总线通信在线重构方法，具体涉及串行总线通信技术领域；通过将若干个重构文件预加载到DDR缓存中，利用错误检测与纠正机制实时监测和记录数据加载中的错误情况，对单比特错误数量的波动和重构文件的校验失败率变化情况进行分析后，确定DDR缓存过程中数据的准确性，并将其划分为准确性数据、可能准确性数据和不准确性数据，以确保准确性数据能够安全地用于FPGA的重构，同时对不准确性数据进行隔离，防止其影响系统运行，此外，可能准确性数据将接受风险评估，并在必要时提高校验频率，从而显著提高系统的稳定性和可靠性，防止因数据损坏引发的功能故障或系统崩溃。

本发明授权基于FPGA的串行总线通信在线重构方法在权利要求书中公布了：1.基于FPGA的串行总线通信在线重构方法，其特征在于：包括以下步骤；S1：对FPGA、DDR缓存和串行总线通信接口进行初始化，并将初始化后的若干个FPGA重构文件从外部存储设备通过串行总线加载到DDR缓存中，进行预加载；S2：在预加载完成时，通过错误检测与纠正机制提供错误统计报告，记录在加载过程中发现和纠正的错误，对加载过程中纠正的单比特错误的数量波动情况进行分析，确定DDR缓存过程中数据错误率异常程度；S3：当DDR缓存过程中数据错误率异常程度高时，记录在重构过程中，FPGA加载失败以及文件校验不通过的次数，计算重构文件校验失败率，对固定时间段内重构文件校验失败率变化情况进行分析后，确定DDR缓存中的数据损毁程度；S4：对DDR缓存过程中数据错误率异常程度和DDR缓存中的数据损毁程度进行分析，评估DDR缓存过程中数据的准确性，并根据评估结果，将DDR缓存过程中数据的准确性划分为准确性数据，可能准确性数据和不准确性数据；S5：对于DDR缓存过程中的准确性数据直接用于FPGA的重构，对于DDR缓存过程中的不准确性数据进行隔离，防止其被用于FPGA的重构，对于DDR缓存过程中的可能准确性数据，对后续DDR缓存过程中可能准确性数据的使用风险性进行评估，若风险性高，则增加对其的校验频率。

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