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龙图腾网恭喜泉芯电子技术(深圳)有限公司申请的专利带采样负载电流技术的低功耗高电源抑制比LDO电路及算法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115542988B 。

龙图腾网通过国家知识产权局官网在2025-05-09发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211137078.9，技术领域涉及：G05F1/56；该发明授权带采样负载电流技术的低功耗高电源抑制比LDO电路及算法是由杨忠添;吴玉强设计研发完成，并于2022-09-19向国家知识产权局提交的专利申请。

本带采样负载电流技术的低功耗高电源抑制比LDO电路及算法在说明书摘要公布了：本发明涉及带采样负载电流技术的低功耗高电源抑制比LDO电路及算法。电路中的输出电流动态采样电路接误差放大器动态偏置输入端；误差放大器的反相输入与基准电压源VREF连接，误差放大器输出端与调整管、采样管的控制端连接，调整管通过电阻反馈电路接误差放大器正相输入端；调整管输入端接供电电源，调整管和电阻反馈电路公共端作为低压差线性稳压器电路的输出端；误差放大器将电阻反馈电路输出反馈电压VFB与基准电压VREF比较产生误差信号，通过对误差信号放大对调整管调节；通过采样负载电流反馈至误差放大器偏置电流分配电路，提高中高频误差放大器增益，也增加误差放大器带宽。

本发明授权带采样负载电流技术的低功耗高电源抑制比LDO电路及算法在权利要求书中公布了：1.一种带采样负载电流技术的低功耗高电源抑制比LDO电路，其特征在于，包括：带动态电流偏置的误差放大器、调整管MP、电阻反馈电路、基准电路、输出电流采样电路：所述输出电流采样电路连接误差放大器动态偏置输入端；所述误差放大器的反相输入与基准电压源VREF连接，所述误差放大器的输出端与所述调整管MP的控制端以及输出电流采样电路输入端连接，所述调整管MP通过所述电阻反馈电路连接所述误差放大器的正相输入端；所述调整管的输入端连接供电电源，所述调整管MP和所述电阻反馈电路的公共端作为低压差线性稳压器电路的输出端；所述误差放大器将所述电阻反馈电路输出的反馈电压VFB与基准电压VREF进行比较产生误差信号，通过对所述误差信号进行放大对所述调整管MP进行调节；通过采样负载电流反馈至误差放大器中的偏置电流，在提高中高频误差放大器的增益同时，也增加了误差放大器的带宽；所述输出电流采样电路，包括第一晶体管M1、第二晶体管M2、第十八晶体管MS；所述第十八晶体管MS的输入端连接供电电源，所述第十八晶体管MS的输出端连接第一晶体管M1输出端以及第一晶体管M1和第二晶体管M2的控制端，所述第二晶体管M2输出端连接误差放大器动态偏置输入端，所述第一晶体管M1和第二晶体管M2的输入端连接接地端；所述误差放大器包括：第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第七晶体管M7、第八晶体管M8、第九晶体管M9、第十晶体管M10、第十一晶体管M11、第十二晶体管M12、第十三晶体管M13、第十四晶体管M14、第十五晶体管M15、第十六晶体管M16和第十七晶体管M17；所述第五晶体管M5的输入端连接所述供电电源，所述第五晶体管M5的控制端连接第四偏置电压Vb4，所述第五晶体管M5的输出端分别连接所述第六晶体管M6的输入端和所述第七晶体管M7的输入端；所述第六晶体管M6的控制端作为误差放大器的正相输入端连接所述反馈电路，第七晶体管M7的控制端作为所述误差放大器的反相输入端连接所述基准电压源VREF；所述第十六晶体管M16的输入端和所述第十七晶体管M17的输入端均连接所述供电电源，所述第十六晶体管M16的输出端以及控制端和所述第十七晶体管M17的控制端连接；所述第十四晶体管M14的输入端连接所述第十六晶体管M16的输出端，所述第十四晶体管M14的控制端连接所述第十五晶体管M15的控制端且两个控制端的公共端连接第一偏置电压Vb1，所述第十五晶体管M15的输入端连接所述第十七晶体管M17的输出端；所述第十二晶体管M12的输入端连接所述第十四晶体管M14的输出端，所述第十二晶体管M12的控制端连接所述第十三晶体管M13的控制端且两个控制端的公共端连接第二偏置电压Vb2，所述第十三晶体管M13的输入端连接所述第十五晶体管M15的输出端，其中，所述第十三晶体管M13和所述第十五晶体管M15的公共端作为所述误差放大器的输出端；所述第十晶体管M10的输入端连接所述第十二晶体管M12的输出端，且所述第十晶体管M10的输入端连接所述第六晶体管M6的输出端，所述第十晶体管M10的输出端连接接地端，所述第十晶体管M10的控制端连接所述第十一晶体管M11的控制端且两个控制端的公共端连接第三偏置电压Vb3，所述第十一晶体管M11的输入端连接所述第十三晶体管M13的输出端，且所述第十三晶体管M13的输入端连接所述第七晶体管M7的输出端，所述第十三晶体管M13的输出端连接接地端；所述第三晶体管M3的输入端和所述第四晶体管M4的输入端均连接所述供电电源，所述第三晶体管M3的输出端连接所述第二晶体管M2输出端，所述第三晶体管M3的控制端连接所述第四晶体管M4的控制端且两个控制端的公共端连接所述第二晶体管M2输出端，所述第四晶体管M4的输出端连接分别连接所述第六晶体管M6的输入端和所述第七晶体管M7的输入端；所述第八晶体管M8的输入端和所述第九晶体管M9的输入端均连接所述接地端，所述第八晶体管M8控制端连接所述第九晶体管M9控制端且两个控制端的公共端连接所述第十八晶体管MS输出端，所述第八晶体管M8的输入端连接所述第十二晶体管M12的输出端，所述第九晶体管M9的输入端连接所述第十三晶体管M13的输出端。

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