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恭喜合肥芯存半导体有限公司;西安芯存半导体有限公司;北京芯存集成电路有限公司;上海芯存志远半导体有限公司方海彬获国家专利权

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龙图腾网恭喜合肥芯存半导体有限公司;西安芯存半导体有限公司;北京芯存集成电路有限公司;上海芯存志远半导体有限公司申请的专利延时锁相环电路及系统装置获国家发明授权专利权,本发明授权专利权由国家知识产权局授予,授权公告号为:CN119254217B

龙图腾网通过国家知识产权局官网在2025-05-16发布的发明授权授权公告中获悉:该发明授权的专利申请号/专利号为:202411275331.6,技术领域涉及:H03L7/081;该发明授权延时锁相环电路及系统装置是由方海彬;黄碧云设计研发完成,并于2024-09-11向国家知识产权局提交的专利申请。

延时锁相环电路及系统装置在说明书摘要公布了:本发明提供一种延时锁相环电路及系统装置,该延时锁相环电路在原有的DLL电路的架构含第1鉴相器上,增加第1至第2a+1延时电路以及第2至第2a+1鉴相器,且第1延时电路设置在可控延时链和时钟缓冲电路之间,第2至第2a+1延时电路级联并对复制时钟缓冲电路输出的反馈时钟信号进一步延时,由此第2至第2a+1延时电路和复制时钟缓冲电路共产生2a+1个反馈时钟信号,第1至第2a+1鉴相器检测这些反馈时钟信号与外部时钟信号的相位关系,使得控制电路至少能根据这些鉴相器的检测结果,快速判断出输出时钟信号与外部时钟信号的相位差小于1C该1C为可控延时链粗调的单位长度或者分别小于2C和1C的时刻,从而减少锁定步骤,缩短锁定时间,加快DLL电路的锁定。

本发明授权延时锁相环电路及系统装置在权利要求书中公布了:1.一种延时锁相环电路,包括可控延时链、时钟缓冲电路、复制时钟缓冲电路和控制电路,其特征在于,还包括第1至第2a+1延时电路以及第1至第2a+1鉴相器,a≥1且为整数,其中:第1延时电路的输入端和所述复制时钟缓冲电路的输入端均耦接所述可控延时链的输出端,第1延时电路的输出端耦接所述时钟缓冲电路的输入端,所述时钟缓冲电路用于将所述第1延时电路输出的时钟信号输出为相应的输出时钟信号,第2至第2a+1延时电路依次级联,且第2延时电路的输入端耦接所述复制时钟缓冲电路的输出端;第1至第2a+1鉴相器的第一输入端和所述可控延时链的输入端均耦接外部时钟信号,第1鉴相器的第二输入端耦接所述复制时钟缓冲电路的输出端,第2至第2a+1鉴相器的第二输入端一一对应地耦接第2至第2a+1延时电路的输出端,第1至第2a+1鉴相器的输出端均耦接所述控制电路的相应输入端,所述控制电路的输出端耦接所述可控延时链的控制端;所述第1延时电路用于对所述可控延时链输出的时钟信号进行特定时长的延时后输出给所述时钟缓冲电路;所述第2至第2a+1延时电路用于对所述复制时钟缓冲电路输出的反馈时钟信号进行相应于所述特定时长的延时,以输出对应的反馈时钟信号;所述第1至第2a+1鉴相器用于检测所述复制时钟缓冲电路和所述第2至第2a+1延时电路输出的反馈时钟信号分别与所述外部时钟信号之间的相位关系;所述控制电路用于根据所述第1至第2a+1鉴相器的检测结果先对所述可控延时链进行粗调,并根据所述检测结果判断是否要从所述粗调切换为细调,在所述粗调完成后再对所述可控延时链进行所述细调,以使所述输出时钟信号和所述外部时钟信号相位同步。

如需购买、转让、实施、许可或投资类似专利技术,可联系本专利的申请人或专利权人合肥芯存半导体有限公司;西安芯存半导体有限公司;北京芯存集成电路有限公司;上海芯存志远半导体有限公司,其通讯地址为:230051 安徽省合肥市经济技术开发区清华路368号合肥格易集成电有限公司辅楼5层01室;或者联系龙图腾网官方客服,联系龙图腾网可拨打电话0551-65771310或微信搜索“龙图腾网”。

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