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龙图腾网恭喜中国人民解放军海军工程大学申请的专利一种系统级数字电路升级优化方法及装置获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115496022B 。

龙图腾网通过国家知识产权局官网在2025-06-13发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211128304.7，技术领域涉及：G06F30/337；该发明授权一种系统级数字电路升级优化方法及装置是由叶慧娟;黄麟舒;周浩设计研发完成，并于2022-09-16向国家知识产权局提交的专利申请。

本一种系统级数字电路升级优化方法及装置在说明书摘要公布了：本发明提供了一种系统级数字电路升级优化方法及装置，属于电路设计技术领域，方法包括：根据被优化数字系统原理图生成元件清单和网络表，根据输入输出电平、元件数目和集成芯片来源确定优化设计所用芯片型号；按被优化数字系统种类对元件清单中各种元件的最小逻辑单元进行VHDL语言建模，将以元件为主体的网络表转换为以最小逻辑单元为主体的网络表；对无法使用VHDL语言建模的阻容元件电路改成数字延迟电路描述，对单稳态电路改用数字触发电路描述；计算功能模块的占用资源数，根据芯片存储容量与功能模块的占用资源总数，对功能模块合并或分割，快速实现多芯片的资源分配。

本发明授权一种系统级数字电路升级优化方法及装置在权利要求书中公布了：1.一种系统级数字电路升级优化方法，其特征在于，包括以下步骤： S1：根据被升级优化的数字系统原理图生成元件清单和网络表，并根据输入输出电平和元件数目，确定优化设计所用芯片序列；其中，网络表用于记载各元件间的输入输出连接关系； S2：对元件清单中每种元件的最小逻辑单元进行VHDL语言建模，并计算每个最小逻辑单元所需资源数；其中，所需资源数包括宏单元、CLB和管脚数； S3：采用最小逻辑单元的VHDL语言描述将以元件为主体的网络表转换为以最小逻辑单元为主体的网络表；其中，输入网络名用于表征最小逻辑单元输入连接关系； S4：对无法使用VHDL语言建模的阻容元件电路改成数字延迟电路描述，对单稳态电路改用数字触发电路描述，更新工件清单的数据库； S5：结合最小逻辑单元的输入网络名以及最小逻辑单元的实现功能，将更新后的数据库进行功能模块的划分，并计算各功能模块的占用资源数；其中，功能模块为实现相同运算的最小逻辑单元设计至一个模块构建； S6：当优化设计所用芯片存储容量大于单个功能模块的占用资源总数时，则合并多个功能模块；若单个功能模块设计需占用多个芯片，则根据功能模块的占用资源总数与芯片的存储容量确定所需芯片数N，对各芯片分别以功能模块1N输入管脚数为起始端，同类网络名优先，根据以最小逻辑单元为单元的网络表绘制的网络拓扑图进行拓展搜索直至到被优化数字系统输出端进行设计，再在每个设计后的芯片上添加功能模块切割产生的附加管脚。

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