申请/专利权人：西安电子科技大学重庆集成电路创新研究院

申请日：2021-12-13

公开（公告）日：2022-04-22

公开（公告）号：CN114389615A

主分类号：H03M1/12

分类号：H03M1/12

优先权：

专利状态码：在审-实质审查的生效

法律状态：2022.05.10#实质审查的生效;2022.04.22#公开

摘要：本发明公开了一种基于环形放大器的MDAC，该MDAC呈上下对称的伪差分结构，本实施例的环形放大器没有内部极点，相比传统多级米勒补偿运放，在实现相同带宽下所用功耗更低，即能效更高；并且本发明的环形放大器在第三级引入增益补偿MOS管，在输出电压接近电源轨时，增益补偿MOS管形成的正反馈机制会补偿输出电压接近电源轨时的增益下降，从而得到一个范围更大更平坦的开环增益与输出电压的曲线，相比传统运放，在相同的线性度指标下，本实施例的环形放大器的输出摆幅更大。同时本发明的环形放大器在电源轨之间堆叠的MOS管最多是三个，适用于低压的先进工艺。

主权项：1.一种基于环形放大器的MDAC，其特征在于，所述基于环形放大器的MDAC呈上下对称的伪差分结构，所述基于环形放大器的MDAC包括：第一环形放大器RINGAMP1、第二环形放大器RINGAMP2、第一前级采样电容CS1、第二前级采样电容CS2，第一反馈电容CF1、第二反馈电容CF2，第一负载电容CL1、第二负载电容CL2、第一共模反馈电容C1、第二共模反馈电容C2、第三共模反馈电容C3、第四共模反馈电容C4、第一自动归零电容CAZ1、第二自动归零电容CAZ2、第一开关S1、第二开关S2、第三开关S3、第四开关S4、第五开关S5、第六开关S6、第七开关S7、第八开关S8、第九开关S9、第十开关S10、第十一开关S11、第十二开关S12、第十三开关S13、第十四开关S14以及第十五开关S15，所述第一前级采样电容CS1一端与所述第一开关S1的一端相连，并接入正端余量输入信号VRESP，所述第一前级采样电容CS1另一端接入电源地；所述第一开关S1的另一端与所述第二开关S2的一端、所述第一自动归零电容CAZ1的一端以及所述第一反馈电容CF1的一端相连，所述第二开关S2的另一端接入共模电压VCM；所述第一自动归零电容CAZ1的另一端与所述第一环形放大器RINGAMP1的输入以及第一共模反馈电容C1的一端相连；所述第一反馈电容CF1的另一端与所述第三开关S3的一端以及所述第四开关S4的一端相连，所述第四开关S4的另一端接入共模电压VCM；所述第三开关S3的另一端与所述第一环形放大器RINGAMP1的输出、所述第五开关S5的一端以及所述第七开关S7的一端相连；所述第七开关S7的另一端与所述第一负载电容CL1的一端相连，并接入负端输出信号VOUTN信号，所述第一负载电容CL1的另一端接入电源地；所述第五开关S5的另一端与所述第六开关S6的一端以及所述第三共模反馈电容C3的一端相连，所述第六开关S6的另一端接入共模电压VCM；所述第二前级采样电容CS2一端与所述第八开关S8的一端相连，并接入负端余量输入信号VRESN，所述第二前级采样电容CS2的另一端接入电源地；所述第八开关S8的另一端与所述第九开关S9的一端、所述第二自动归零电容CAZ2的一端以及所述第二反馈电容CF2的一端相连，所述第九开关S9的另一端接入共模电压VCM；所述第二自动归零电容CAZ2的另一端与所述第二环形放大器RINGAMP2的输入以及第二共模反馈电容C2的一端相连；所述第二反馈电容CF2的另一端与所述第十开关S10的一端以及所述第十一开关S11的一端相连，所述第十一开关S11的另一端接入共模电压VCM；所述第十开关S10的另一端与所述第二环形放大器RINGAMP2的输出、所述第十二开关S12的一端以及所述第十四开关S14的一端相连；所述第十四开关S14的另一端与所述第二负载电容CL2的一端相连，并接入正端输出信号VOUTP信号，所述第二负载电容CL2的另一端接入电源地；所述第十二开关S12的另一端与所述第十三开关S13的一端以及所述第四共模反馈电容C4的一端相连，所述第十三开关S13的另一端接入共模电压VCM；所述第一共模反馈电容C1的另一端、所述第二共模反馈电容C2的另一端、所述第三共模反馈电容C3的另一端、所述第四共模反馈电容C4的另一端以及所述第十五开关S15的一端连接在一起，形成的连接节点为内部共模节点VCMFB。

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百度查询： 西安电子科技大学重庆集成电路创新研究院 一种基于环形放大器的MDAC

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