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一种通过逻辑芯片实现的自适应SGPIO解码器及程序 

申请/专利权人:苏州浪潮智能科技有限公司

申请日:2020-10-23

公开(公告)日:2023-01-06

公开(公告)号:CN112286855B

主分类号:G06F13/42

分类号:G06F13/42;G06F11/32

优先权:

专利状态码:有效-授权

法律状态:2023.01.06#授权;2021.02.23#实质审查的生效;2021.01.29#公开

摘要:本发明公开一种通过逻辑芯片实现的自适应SGPIO解码器及程序,其中,通过逻辑芯片电性连接通道选择器的输出端;所述通道选择器的输入端分别连接RAID卡和南桥芯片;所述RAID卡电性连接SAS硬盘,所述南桥芯片电性连接SATA硬盘;所述逻辑芯片电性连接SAS硬盘指示灯和SATA硬盘指示灯。本发明通过通道选择器连接所述逻辑芯片,只需1组SGPIO信道连接到所述逻辑芯片,能够精简PCB线路,减少所述逻辑芯片IO口的占用;对于所述逻辑芯片,由于仅采用一组SGPIO解码电路就能够实现对两种不同的SGPIO信号的解码,从而降低所述逻辑芯片的逻辑资源耗用,降低成本。只需极小的修改程序即可应对其它特殊应用不同长度的SGPIO信号解析,方便厂商根据自身产品需求设计硬盘指示灯的控制。

主权项:1.一种通过逻辑芯片实现的自适应SGPIO解码器,其特征在于,包括逻辑芯片(1),其中,所述逻辑芯片(1)电性连接通道选择器(2)的输出端;所述逻辑芯片(1)配置检测计数模块(11)、信号解析模块(12)和存储模块(13),通道选择器(2)的输出端电性连接所述检测计数模块(11);所述通道选择器(2)的输入端分别连接RAID卡(3)和南桥芯片(4);所述RAID卡(3)电性连接SAS硬盘,所述南桥芯片(4)电性连接SATA硬盘;所述逻辑芯片(1)电性连接SAS硬盘指示灯和SATA硬盘指示灯;当所述检测计数模块计数量为24时,所述逻辑芯片(1)根据所述存储模块(13)中的控制数据控制所述SATA硬盘指示灯;当所述检测计数模块计数量12时,所述逻辑芯片(1)根据所述存储模块(13)中的控制数据控制所述SAS硬盘指示灯。

全文数据:

权利要求:

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