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申请/专利权人：苏州迅芯微电子有限公司

摘要：一种用于流水线模数转换器中MDAC的输出共模抑制电路，包括两相时钟的共模反馈电路，所述的共模反馈电路分为两部分，两部分共模反馈电路同时工作在两相高电平不交叠时钟下，两相时钟的共模反馈电路连接MDAC的运算放大器输出端。所述共模反馈电路两相高电平不交叠时钟的占空比一致并且均不超过50％。本发明运用共模反馈电路可以使运放在悬空时刻的输出也维持在共模电压附近，从而较好的抑制运放输出端悬空时输出共模的剧烈变化，并避免在运放建立时钟到来时由于共模漂移问题而占用过长的运放建立时间。

主权项：1.一种用于流水线模数转换器中MDAC的输出共模抑制电路，其特征在于：包括两相时钟的共模反馈电路，所述的共模反馈电路分为两部分，两部分共模反馈电路同时工作在两相高电平不交叠时钟下，两相时钟的共模反馈电路连接MDAC的运算放大器输出端；所述的共模反馈电路包括三条与运算放大器三个输出端相连的并列支路；其中，每条支路上均设置有第一相不交叠时钟开关Φ1和第二相不交叠时钟开关Φ2，三条并列支路之间连接开关电容C1和开关电容C2，开关电容C1的两端连接在第一相不交叠时钟开关Φ1和第二相不交叠时钟开关Φ2之间的相邻两条并列支路上，开关电容C2的两端连接在运算放大器输出端和第二相不交叠时钟开关Φ2之间的相邻两条并列支路上；所述的运算放大器三个输出端同时连接两组结构对称的共模反馈电路；所述第一相不交叠时钟开关Φ1和第二相不交叠时钟开关Φ2的电荷计算方式如下：Φ1时刻：Q＝Vcm-Vb·C1+Voutpn-1-VCMBn-1·C2；Φ2时刻：Q＝Voutpn-VCMBn·C1+Voutpn-VCMBn·C2；得到：式中，Vcm为运放的输出共摸，Vb为运放NMOS尾电流源的偏置电压，Voutp为运放的正向输出端电压，VCMB为共摸反馈得到的反馈电压；开关电容共模反馈通过每次电荷转移使Vout-VCMB稳定在Vcm-Vb附近，如下式所示： 当Vb取值接近Vcm，则Vout处于VCMB附近，如此对运算放大器的输出进行了置位操作，在运算放大器不工作时处于共模电平附近，当下一时刻运算放大器开始工作时，输出电压的起始状态就是共模电平。

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