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申请/专利权人：道芬设计公司
申请日：2022-07-15
公开（公告）日：2024-04-26
公开（公告）号：CN117941259A
主分类号：H03K3/037
分类号：H03K3/037;H03K3/012;H03K19/003;G01R31/317
优先权：["20210715 FR FR2107642"]
专利状态码：在审-实质审查的生效
法律状态：2024.05.14#实质审查的生效;2024.04.26#公开
摘要：本公开涉及一种电路，其包括：‑第一时序守卫电路200，其被配置为检测第一数据信号到达第一同步装置202的裕量时间何时降到低于第一阈值SLG延迟；以及‑第二时序守卫电路200，其被配置为检测第二数据信号到达第二同步装置202的裕量时间何时降到低于第二阈值SLG延迟，第一阈值和第二阈值彼此不同。
主权项：1.一种电路，其包括：-第一时序守卫电路200,SLG_S，其被配置为检测第一数据信号到达第一同步装置202处的裕量时间何时降到低于第一阈值SLG延迟1；和-第二时序守卫电路200,SLG_A，其被配置为检测第二数据信号到达第二同步装置202处的裕量时间何时降到低于第二阈值SLG延迟2，所述第一阈值和第二阈值彼此不相同。
全文数据：
权利要求：
百度查询： 道芬设计公司 用于检测数字电路中时序违例的电路
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