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申请/专利权人：ARM有限公司
申请日：2019-07-02
公开（公告）日：2024-06-07
公开（公告）号：CN110675900B
主分类号：G11C7/22
分类号：G11C7/22;G11C7/10;H03K7/08
优先权：["20180703 US 16/026,946"]
专利状态码：有效-授权
法律状态：2024.06.07#授权;2021.07.23#实质审查的生效;2020.01.10#公开
摘要：本文描述的各种实施方式涉及一种集成电路，该集成电路具有时钟生成电路，该时钟生成电路接收输入时钟信号并提供具有第一脉冲宽度的第一时钟信号。集成电路包括耦接在时钟生成电路与输入锁存控制电路之间的第一脉冲展宽电路。第一脉冲展宽电路接收第一时钟信号，并基于使能信号向输入锁存控制电路提供第二时钟信号。第二时钟信号具有至少大于第一脉冲宽度的第二脉冲宽度。集成电路可以包括耦接在时钟生成电路与读写电路之间的第二脉冲展宽电路。第二脉冲展宽电路基于使能信号向读写电路提供第三时钟信号。第三时钟信号具有至少大于第一脉冲宽度的第三脉冲宽度。
主权项：1.一种集成电路，包括：时钟生成电路，接收输入时钟信号，并提供具有第一脉冲宽度的第一时钟信号；第一脉冲展宽电路，耦接在所述时钟生成电路与输入锁存控制电路之间，其中所述第一脉冲展宽电路接收所述第一时钟信号，并基于使能信号向所述输入锁存控制电路提供第二时钟信号，并且其中所述第二时钟信号具有至少大于所述第一脉冲宽度的第二脉冲宽度；以及第二脉冲展宽电路，耦接在所述时钟生成电路与读写电路之间，其中所述第二脉冲展宽电路基于所述使能信号向所述读写电路提供第三时钟信号，并且其中所述第三时钟信号具有至少大于所述第一脉冲宽度的第三脉冲宽度。
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