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申请/专利权人：恩智浦有限公司
申请日：2019-06-12
公开（公告）日：2024-06-11
公开（公告）号：CN110598484B
主分类号：G06F21/72
分类号：G06F21/72
优先权：["20180612 US 16/006,457"]
专利状态码：有效-授权
法律状态：2024.06.11#授权;2021.07.02#实质审查的生效;2019.12.20#公开
摘要：本发明涉及同步故障注入的故障攻击防护。各种实施例涉及一种电路，其包括：第一安全电路，其被配置成接收输入并产生第一输出；第一延迟电路，其被配置成接收所述第一输出并产生延迟时间N的第一延迟输出；第二延迟电路，其被配置成接收所述输入并产生延迟时间N的延迟输入；第二安全电路，其被配置成接收所述延迟输入并产生第二延迟输出；以及比较器，其被配置成比较所述第一延迟输出与所述第二延迟输出并产生结果，其中当所述第一延迟输出匹配所述第二延迟输出时所述结果是所述第一延迟输出或所述第二延迟输出中的一个且当所述第一延迟输出不匹配所述第二延迟输出时所述结果是误差值。
主权项：1.一种电路，其特征在于，包括：第一安全电路，其被配置成接收输入并产生第一输出；第一延迟电路，其被配置成接收所述第一输出并产生延迟时间N的第一延迟输出；第二延迟电路，其被配置成接收所述输入并产生延迟时间N的延迟输入；第二安全电路，其被配置成接收所述延迟输入并产生第二延迟输出；比较器，其被配置成比较所述第一延迟输出与所述第二延迟输出并产生结果，其中当所述第一延迟输出匹配所述第二延迟输出时所述结果是所述第一延迟输出或所述第二延迟输出中的一个，且当所述第一延迟输出不匹配所述第二延迟输出时所述结果是误差值；以及第三延迟电路，其被配置成接收所述结果并产生延迟时间M的延迟结果；所述N值周期性地改变。
全文数据：
权利要求：
百度查询： 恩智浦有限公司 同步故障注入的故障攻击防护
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