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申请/专利权人：深圳高铂科技有限公司

摘要：本发明公开了一种单芯片校准系统及方法，包括电子设备、ALPG和校准设备，电子设备连接ALPG，ALPG连接芯片，芯片与校准设备连接，每个芯片包括多个IO口，多个IO口中包括多组IO口，多组IO口中第n组IO口中包括第2n‑1个IO口、第2n个IO口、第2n+1个IO口和第2n+2个IO口，n为正整数，第2n‑1个IO口、第2n个IO口、第2n+1个IO口和第2n+2个IO口彼此相邻，校准设备包括第一校准设备和第二校准设备，本申请可以提高芯片校准的准确性。

主权项：1.一种单芯片校准系统，其特征在于，包括电子设备、ALPG和校准设备，所述电子设备连接所述ALPG，所述ALPG连接所述芯片，所述芯片与所述校准设备连接，每个所述芯片包括多个IO口，所述多个IO口中包括多组IO口，所述多组IO口中第n组IO口中包括第2-1个IO口、第2个IO口、第2+1个IO口和第2+2个IO口，n为正整数，所述第2-1个IO口、所述第2个IO口、所述第2+1个IO口和所述第2+2个IO口彼此相邻，所述校准设备包括第一校准设备和第二校准设备，其中：所述电子设备，用于向所述ALPG发送第一控制信号，所述第一控制信号用于所述ALPG向所述芯片发送第一校准信号，所述第一校准信号用于所述芯片通过第2-1个IO口向所述第一校准设备发送所述第一校准信号；所述第一校准设备，用于通过所述第2个IO口向所述芯片发送所述第一校准信号；所述电子设备，还用于向所述ALPG发送第二控制信号，所述第二控制信号用于所述ALPG向所述芯片发送第二校准信号，所述第二校准信号用于所述芯片通过第2+2个IO口向所述第一校准设备发送所述第二校准信号；所述第一校准设备，还用于通过所述第2+1个IO口向所述芯片发送所述第二校准信号；所述电子设备，还用于在所述第2个IO口和所述第2+1个IO口延迟相同的情况下，确定所述第2-1个IO口和所述第2+2个IO口的第一校准时间；所述电子设备，还用于向所述ALPG发送第三控制信号，所述第三控制信号用于所述ALPG向所述芯片发送第三校准信号，所述第三校准信号用于所述芯片通过第2+3个IO口向所述第一校准设备发送所述第三校准信号，所述第2+3个IO口与所述第2+2个IO口相邻；所述第一校准设备，还用于通过所述第2个IO口向所述芯片发送所述第三校准信号；所述电子设备，还用于向所述ALPG发送第四控制信号，所述第四控制信号用于所述ALPG向所述芯片发送第四校准信号，所述第四校准信号用于所述芯片通过第2+2个IO口向所述第一校准设备发送所述第四校准信号；所述第一校准设备，还用于通过所述第2+1个IO口向所述芯片发送所述第四校准信号；所述电子设备，还用于在所述第2+2个IO口和所述第2+3个IO口延迟相同的情况下，确定所述第2个IO口和所述第2+1个IO口的第二校准时间；所述电子设备，还用于向所述ALPG发送第五控制信号，所述第五控制信号用于所述ALPG向所述芯片发送第五校准信号，所述第五校准信号用于所述芯片通过第2个IO口向所述第二校准设备发送所述第五校准信号；所述第二校准设备，用于通过所述第2+1个IO口向所述芯片发送所述第五校准信号；所述电子设备，还用于向所述ALPG发送第六控制信号，所述第六控制信号用于所述ALPG向所述芯片发送第六校准信号，所述第六校准信号用于所述芯片通过第2+3个IO口向所述第二校准设备发送所述第六校准信号；所述第二校准设备，还用于通过所述第2+2个IO口向所述芯片发送所述第六校准信号；所述电子设备，还用于在所述第2+1个IO口和所述第2+2个IO口延迟相同的情况下，确定所述第2个IO口和所述第2+3个IO口的第三校准时间；所述电子设备，还用于向所述ALPG发送第七控制信号，所述第七控制信号用于所述ALPG向所述芯片发送第七校准信号，所述第七校准信号用于所述芯片通过第2+1个IO口向所述第一校准设备发送所述第七校准信号；所述第二校准设备，还用于通过所述第2个IO口向所述芯片发送所述第七校准信号；所述电子设备，还用于向所述ALPG发送第八控制信号，所述第八控制信号用于所述ALPG向所述芯片发送第八校准信号，所述第八校准信号用于所述芯片通过第2+2个IO口向所述第二校准设备发送所述第八校准信号；所述第二校准设备，还用于通过所述第2-1个IO口向所述芯片发送所述第八校准信号；所述电子设备，还用于在所述第2+1个IO口和所述第2+2个IO口延迟相同的情况下，确定所述第2-1个IO口和所述第2个IO口的第四校准时间；所述电子设备，还用于根据所述第一校准时间和所述第三校准时间确定第五校准时间；所述电子设备，还用于根据所述第二校准时间和所述第四校准时间确定第六校准时间；所述电子设备，还用于根据所述第五校准时间和所述第六校准时间确定校准延迟；所述电子设备，还用于根据所述校准延迟对所述芯片进行校准。

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