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申请/专利权人：成都玖锦科技有限公司

摘要：本发明公开了一种基于FPGA并行架构的多通道联动同步触发方法，所述FPGA并行架构包括上位机、两个FPGA处理板，每一个FPGA处理板的前端连接有四个采集卡；每一个采集卡均具有自身的编号，每一个所述的采集卡包括数据存储与控制模块，以及一级触发处理模块；每一个所述的FPGA处理板均包括触发控制模块、一级触发判断处理模块、触发源选择控制模块、触发配置模块、二级触发判断处理模块，以及数据接收处理模块，本发明的方法中两片FPGA之间能够互相联动，当选择任意一片FPGA连接的采集卡作为触发源时，能够对另一片FPGA及其连接的采集卡进行同步触发，实现FPGA之间的联动。

主权项：1.一种基于FPGA并行架构的多通道联动同步触发方法，其特征在于：所述FPGA并行架构包括上位机、两个FPGA处理板，每一个FPGA处理板的前端连接有四个采集卡；每一个采集卡均具有自身的编号，每一个所述的采集卡包括数据存储与控制模块，以及一级触发处理模块；每一个所述的FPGA处理板均包括触发控制模块、一级触发判断处理模块、触发源选择控制模块、触发配置模块、二级触发判断处理模块，以及数据接收处理模块，所述数据接收处理模块包括接收缓存单元、数据拼合单元、拼合信号缓存控制单元和数据发送单元；所述方法包括以下步骤：S1.在每一个采集板中，数据存储与控制模块根据上位机的初始指令，对该采集板的输入信号进行存储和输出的控制，输出的信号给自身连接的FPGA处理板中的数据接收处理模块，同时利用一级触发处理模块对数据存储与控制模块输出的信号进行触发判断，得到触发信号传输给FPGA处理板中的触发源选择控制模块；S2.从两个FPGA处理板中选择一个作为主处理板，记为FPGA-A，另一个作为从处理板，记为FPGA-B；S3.从上位机向两个FPGA处理板的触发配置模块下发配置信息，所述配置信息包括：作为触发源的采集卡编号、一级触发判断处理的软件程序包和二级触发判断处理的软件程序包；若作为触发源的采集卡编号为FPGA-A连接的采集卡编号，则FPGA-A的触发配置模块将作为触发源的采集卡编号传输给FPGA-A中的触发源选择控制模块，FPGA-A中的触发源选择控制模块从FPGA-A连接的四个采集卡中，选择接收到的采集卡编号对应采集卡输出的触发信号，传输给FPGA-A中的一级触发判断处理模块；若作为触发源的采集卡编号为FPGA-B连接的采集卡编号，则FPGA-B的触发配置模块将作为触发源的采集卡编号传输给FPGA-B中的触发源选择控制模块，FPGA-B中的触发源选择控制模块从FPGA-B连接的四个采集卡中，选择接收到的采集卡编号对应采集卡输出的触发信号，传输给FPGA-A中的一级触发判断处理模块；S4.FPGA-A的触发配置模块将配置信息中一级触发判断处理的软件程序包传输给FPGA-A中的一级触发判断处理模块进行加载，并基于加载的程序包对接收到的触发信号进行判断处理，得到一级触发控制信号传输给FPGA-A的触发控制模块；S5.上位机通过触发配置模块向所述FPGA-A的触发控制模块下发读控制信号、写控制信号或复位控制信号，FPGA-A的触发控制模块在接收到一级触发控制信号后，生成一级使能信号，传输给FPGA-A连接的各个采集卡中的存储与控制模块，完成对FPGA-A连接的各个采集卡的触发控制；同时FPGA-A的触发控制模块将一级使能信号同步给FPGA-B的触发控制模块，由FPGA-B的触发控制模块传输给FPGA-B连接的各个采集卡中的存储与控制模块，完成对FPGA-B连接的各个采集卡的同步触发控制；S6.在每一个FPGA处理板中，数据接收处理模块中的接收缓存单元接收该FPGA处理板连接的四个采集板中数据存储与控制模块输出的信号，并传输给数据拼合单元进行数据拼合后得到拼合信号，传输给二级触发判断处理模块，以及拼合信号缓存控制单元；若作为触发源的采集卡编号为FPGA-A连接的采集卡编号，则FPGA-A中的触发配置模块将二级触发判断处理的软件程序包传输给FPGA-A中的二级触发判断处理模块进行加载，并根据接收到的拼合信号产生二级触发控制信号，由上位机通过FPGA-A中触发配置模块向FPGA-A中二级触发判断处理模块下发读写指令，FPGA-A中二级触发判断处理模块在接收到二级触发控制信号时，产生二级使能信号对FPGA-A中拼合信号缓存控制单元的读写进行控制，并将二级使能信号同步到FPGA-B中拼合信号缓存控制单元进行读写同步触发控制；若作为触发源的采集卡编号为FPGA-B连接的采集卡编号，则FPGA-B中的触发配置模块将二级触发判断处理的软件程序包传输给FPGA-B中的二级触发判断处理模块进行加载，并根据接收到的拼合信号产生二级触发控制信号，由上位机通过FPGA-B中触发配置模块向FPGA-B中二级触发判断处理模块下发读写指令，FPGA-B中的二级触发判断处理模块在接收到二级触发控制信号时，产生二级使能信号对FPGA-B中的拼合信号缓存控制单元的读写进行控制，并将二级使能信号同步到FPGA-A中拼合信号缓存控制单元进行读写同步触发控制；S7.将两个FPGA处理板中，拼合信号缓存控制单元的数据通过发送单元传输给上位机。

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