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申请/专利权人：国际商业机器公司
申请日：2020-04-29
公开（公告）日：2024-06-25
公开（公告）号：CN113841124B
主分类号：G06F12/00
分类号：G06F12/00
优先权：["20190521 US 16/417,961"]
专利状态码：有效-授权
法律状态：2024.06.25#授权;2022.01.11#实质审查的生效;2021.12.24#公开
摘要：一种具有由跨处理器网络连接的多个处理器的方法和信息处理系统，其中，多个处理器中的每个优选地具有过滤器结构体，过滤器结构体具有标识专门分配给该处理器的逻辑分区标识LPID的传出过滤器列表和或标识该处理器上和系统中的至少一个其他处理器上的LPID的传入过滤器列表。在操作中，如果传出转换无效指令的LPID在传出过滤器列表上，则代表系统确认地址转换无效指令。如果传入无效指令的LPID与传入过滤器列表上的任何LPID不匹配，则确认转换无效指令，并且，如果传入无效指令的LPID与传入过滤器列表上的任何LPID匹配，则将无效指令发送到相应处理器中。
主权项：1.一种信息处理系统，具有通过跨处理器网络连接的多个处理器，其中，多个处理器中的每个处理器包括：一个或多个地址转换缓冲器，每个地址转换缓冲器具有包括地址转换信息的多个地址转换条目；过滤器结构体，具有标识专门分配给该处理器的逻辑分区标识LPID的传出过滤器列表；其中，系统在操作中被设计和配置为：在处理系统中的多个处理器之一中发布具有LPID的地址转换无效指令；检查发布地址转换无效指令的处理器中的传出过滤器列表；确定地址转换无效指令的LPID是否与传出过滤器列表中的LPID的任何一个匹配；和至少部分响应于地址转换无效指令的LPID与传出过滤器列表中的LPID中的任何一个匹配，代表系统确认地址转换无效指令。
全文数据：
权利要求：
百度查询： 国际商业机器公司 微处理器中的地址转换高速缓存无效
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