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申请/专利权人：北京安酷智芯科技有限公司

摘要：本发明公开了一种用于模数转换器ADC的具有失调电压自校正功能的源跟随基准缓冲器包括：栅压偏置级、输出驱动级、失调自校正控制器和叠加型校正数模转换器DAC；其中栅压偏置级包括：误差放大器A1、输入晶体管MI1和负载ZL1；输出驱动级包括：输入晶体管MI2和负载ZL2；失调自校正控制器包括：高精度比较器A2、SAR逻辑单元和事件触发器；叠加型校正数模转换器DAC包括：基准电流发生器、复制电流镜和电阻分压器。本发明可在ADC上电完毕或环境变化时，自动校正源跟随基准缓冲器的失调电压，从而提升ADC的绝对值精度和功能集成度、简化ADC误差校正过程的复杂度、保证了ADC的高线性度、低噪声、低功耗等性能。

主权项：1.一种具有失调电压自校正功能的源跟随基准缓冲器，其特征在于，所述缓冲器包括：栅压偏置级、输出驱动级、失调自校正控制器和叠加型校正数模转换器DAC；其中所述栅压偏置级包括：误差放大器A1、输入晶体管MI1和负载ZL1；所述输出驱动级包括：输入晶体管MI2和负载ZL2；所述失调自校正控制器包括：高精度比较器A2、SAR逻辑单元和事件触发器；所述叠加型校正数模转换器DAC包括：基准电流发生器、复制电流镜和电阻分压器；所述栅压偏置级和输出驱动级电路结构中，基准电压源的输出电压VREF连接至误差放大器A1的正输入端，误差放大器A1的负输入端连接输入晶体管MI1的源端，误差放大器A1的输出端连接至输入晶体管MI1的栅端；栅压偏置级中的输入晶体管MI1的源端与负载ZL1相连接，输出驱动级中的输入晶体管MI2的源端与负载ZL2相连接；栅压偏置级中的输入晶体管MI1的栅端通过叠加型校正数模转换器DAC后连接至输出驱动级中的输入晶体管MI2的栅端；在P型PMOS输入晶体管中，输入晶体管MI1和MI2的漏端分别接地，负载ZL1和ZL2同时连接电源VDD；在N型NMOS输入晶体管中，输入晶体管MI1和MI2的漏端同时连接电源VDD，负载ZL1和ZL2分别接地；所述失调自校正控制器中，基准电压源的输出电压VREF连接高精度比较器A2的正输入端，高精度比较器A2的负输入端连接至输入晶体管MI2的源端与负载ZL2之间，作为驱动级的输出电压VRO；高精度比较器A2的输出端连接SAR逻辑单元；事件触发器同时连接高精度比较器A2和SAR逻辑单元，负责接收芯片发送的失调校正起始信号Trigger；SAR逻辑单元输出的校正码值即为校正DAC的输入码值。

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