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一种脉冲发生器及芯片 

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申请/专利权人:上海三菲半导体有限公司

摘要:一种脉冲发生器及芯片,包括:第一脉冲调相电路、第二脉冲调相电路、多路选择器、数模转换器和极性控制电路。其中,第一脉冲调相电路用于生成第一脉冲信号,该第一脉冲信号在一个周期内有4个相位。第二脉冲调相电路用于生成第二脉冲信号,该第二脉冲信号在一个周期内有4个相位。多路选择器的输入端与第一脉冲调相电路的输出端和第二脉冲调相电路的输出端连接。数模转换器的输入端与多路选择器的输出端连接,用于根据极性控制电路的输出以及多路选择器的输出生成目标脉冲信号。极性控制电路的输出端与数模转换器的输入端连接。该脉冲发生器能够在较短的时间内产生较为精确的脉冲波形,且不包括DLL,更加适用于UWB的应用场景。

主权项:1.一种脉冲发生器,其特征在于,包括:第一脉冲调相电路,用于生成第一脉冲信号,所述第一脉冲信号在一个周期内有4个相位,其中,所述第一脉冲调相电路包括相互连接的第一重定时器和第一调相器,所述第一重定时器的输入为触发器生成的触发信号和本地时钟信号,所述第一重定时器的输出端与所述第一调相器的输入端连接,所述第一调相器的输出端与多路选择器的输入端相连,所述第一重定时器包括第一D触发器、与门以及第一缓冲器、第二缓冲器和第三缓冲器,其中,所述第一D触发器的D端接收所述触发信号,所述第一D触发器的时钟输入端接收所述本地时钟信号,所述第一D触发器的Q端分别与所述与门的第一输入端和第二缓冲器的输入端连接;所述与门的第二输入端接收所述本地时钟信号,所述与门的输出端与所述第一缓冲器的输入端连接,所述第一缓冲器的输出端输出第一时钟信号;所述第二缓冲器的输出端与所述第三缓冲器的输入端连接,所述第三缓冲器的输出端输出第一使能信号;所述第一使能信号和所述第一时钟信号用于所述第一调相器生成所述第一脉冲信号;第二脉冲调相电路,用于生成第二脉冲信号,所述第二脉冲信号在一个周期内有4个相位,其中,所述第二脉冲调相电路的输入为本地时钟信号,所述第二脉冲调相电路的输出端与所述多路选择器的输入端相连,所述第二脉冲调相电路的结构和所述第一脉冲调相电路的结构相同;所述多路选择器,所述多路选择器的输入端与所述第一脉冲调相电路的输出端和所述第二脉冲调相电路的输出端连接;数模转换器,所述数模转换器的输入端与所述多路选择器的输出端连接,用于根据极性控制电路的输出以及所述多路选择器的输出生成目标脉冲信号;所述极性控制电路,所述极性控制电路的输出端与所述数模转换器的输入端连接,所述极性控制电路包括第三重定时器,其中,所述第三重定时器包括第二D触发器以及与所述第二D触发器依次连接的第四缓冲器和第五缓冲器,所述第二D触发器的D端输入为初始极性控制信号,所述第二D触发器的时钟输入端接收所述本地时钟信号,所述初始极性控制信号与所述本地时钟信号同步,所述第二D触发器的Q端与所述第四缓冲器的输入端连接,所述第四缓冲器的输出端与所述第五缓冲器的输入端连接,所述第五缓冲器的输出端与所述数模转换器的输入端连接,所述本地时钟信号的周期为所述触发信号和所述初始极性控制信号的时间宽度的1M,所述M的取值范围为[4,32],所述本地时钟信号的频率为4的整数倍。

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