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栅压自举开关电路 

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申请/专利权人:广东工业大学

摘要:本申请涉及一种栅压自举开关电路,包括包括时钟电路、自举路径和复位电路;时钟电路包括MOS管MP3、MOS管MN3,其中,MP3和MN3的栅极接CLKS,MP3和MN3的漏极接CLKSB,MP3的源极和衬底均接VDD,MN3的源极和衬底均接地;复位电路包括MOS管MP1、MOS管MP2、MOS管MN2、MOS管MN6、MOS管MP4以及MN4,其中,MOS管MP1的源极和衬底均接VDD,栅极接CLKS,漏极接VC;MP2的源极接VDD,漏极和衬底均接PA,栅极接VG;MN2的源极和衬底均接地,漏极接PB,栅极接CLKSB;MP4、MN4的栅极接CLKSB,漏极接MOS管MN6的源极,MP4的源极和衬底均接VDD,MN4的源极和衬底均接地,MOS管MN6的栅极接VDD,漏极接VG,衬底接地。本申请能够提升快速自举路径的建立速度。

主权项:1.一种栅压自举开关电路,其特征在于,包括时钟电路、自举路径和复位电路;所述时钟电路包括MOS管MP3、MOS管MN3,其中,所述MOS管MP3和所述MOS管MN3的栅极接第一控制信号CLKS,所述MOS管MP3和MOS管MN3的漏极接第二控制信号CLKSB,所述MOS管MP3的源极和衬底均接电源电压VDD,所述MOS管MN3的源极和衬底均接地;所述自举路径包括MOS管MS、MOS管MN0、MOS管MN6、MOS管MP6、自举电容C1、MOS管MP0、MOS管MP5、MOS管MN1以及MOS管MN5,其中,所述MOS管MS的源极接输入信号VIN,栅极接节点VG,漏极接输出信号VOUT,衬底接PB;所述MOS管MN0以及MOS管MN6的源极和衬底均接节点PB、漏极接输入信号VIN,所述MOS管MN0的栅极接节点VG,所述MOS管MN6的栅极接第一控制信号CLKS;MOS管MP6的栅极接第二控制信号CLKSB、漏极接输入信号VIN、源极接节点PB、衬底接电源电压VDD;自举电容C1上极板接节点PA、下极板接节点PB;所述MOS管MP0、所述MOS管MP5的源极和衬底均接节点PA、漏极接节点VG,所述MOS管MP0栅极接节点VC,所述MOS管MP5的栅极接第二控制信号CLKSB;所述MOS管MN1、所述MOS管MN5的源极和衬底均接节点PB、漏极接节点VC,所述MOS管MN1的栅极接第一控制信号CLKS,所述MOS管MN5的栅极接节点VG;所述复位电路包括MOS管MP1、MOS管MP2、MOS管MN2、MOS管MN6、MOS管MP4以及MOS管MN4,其中,所述MOS管MP1的源极和衬底均接电源电压VDD,栅极接第一控制信号CLKS,漏极接节点VC;所述MOS管MP2的源极接电源电压VDD,漏极和衬底均节点PA,栅极接节点VG;所述MOS管MN2的源极和衬底均接地,漏极接节点PB,栅极接第二控制信号CLKSB;所述MOS管MP4、所述MOS管MN4的栅极接第二控制信号CLKSB,漏极接所述MOS管MN6的源极,所述MOS管MP4的源极和衬底均接电源电压VDD,所述MOS管MN4的源极和衬底均接地,所述MOS管MN6的栅极接电源电压VDD,漏极接节点VG,衬底接地。

全文数据:

权利要求:

百度查询: 广东工业大学 栅压自举开关电路

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