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申请/专利权人：慧荣科技股份有限公司

摘要：本发明涉及一种数据加密的回合密钥扩展装置。寄存器包含存储八个双字的组件，其中的第四到第七双字的组件的输出分别耦接到第零到第三双字的组件的输入。钥字处理电路耦接寄存器的最后一个双字的组件的输出，交错运行在第一模式和第二模式；在第一模式时，依据最后一个双字计算相应于偶数回合密钥的第一中间运算结果；在第二模式时，依据最后一个双字计算相应于奇数回合密钥的第二中间运算结果。第一至第四互斥或门分别对第零双字和钥字处理电路的输出、第一双字和第一互斥或门的输出、第二双字和第二互斥或门的输出、第三双字和第三互斥或门的输出进行逐比特逻辑互斥或运算，并且输出至寄存器中的用于存储所述第四至第七双字的组件。

主权项：1.一种数据加密的回合密钥扩展装置，其特征在于，包括：寄存器，包含设置以存储八个双字的组件，其中，所述寄存器中的第四个到第七个双字的组件的输出分别耦接到第零个到第三个双字的组件的输入；钥字处理电路，耦接所述寄存器的最后一个双字的输出，设置以交错运行在第一模式和第二模式；在所述第一模式时，依据所述最后一个双字计算相应于偶数回合密钥的第一中间运算结果；以及在所述第二模式时，依据所述最后一个双字计算相应于奇数回合密钥的第二中间运算结果；第一互斥或门，耦接所述寄存器中的所述第零个双字的元件的输出和所述钥字处理电路的输出，设置以对所述第零个双字和所述钥字处理电路的输出进行逐比特逻辑互斥或运算，并且输出第一运算结果至所述寄存器中的用于存储所述第四个双字的组件；第二互斥或门，耦接所述寄存器中的所述第一个双字的元件的输出和所述第一互斥或门的输出，设置以对所述第一个双字和所述第一互斥或门的输出进行逐比特逻辑互斥或运算，并且输出第二运算结果至所述寄存器中的用于存储所述第五个双字的组件；第三互斥或门，耦接所述寄存器中的所述第二个双字的元件的输出和所述第二互斥或门的输出，设置以对所述第二个双字和所述第二互斥或门的输出进行逐比特逻辑互斥或运算，并且输出第三运算结果至所述寄存器中的用于存储所述第六个双字的组件；以及第四互斥或门，耦接所述寄存器中的所述第三个双字的元件的输出和所述第三互斥或门的输出，设置以对所述第三个双字和所述第三互斥或门的输出进行逐比特逻辑互斥或运算，并且输出第四运算结果至所述寄存器中的用于存储所述第七个双字的组件。

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