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申请/专利权人：成都电科星拓科技有限公司
摘要：本发明提供了一种时钟周期检测方法、装置、电子设备及存储介质，涉及集成电路技术领域。该方法应用于时钟周期检测电路中的控制器。控制器输出第一控制码和第一延时码，以使相位插值器根据第一控制码输出第一相位时钟，并使延时链根据第一延时码输出第一延时时钟。若未接收到第一沿对沿对齐信号，则对第一控制码进行累加调节码操作，直至接收到第二沿对沿对齐信号，并输出第二控制码。对第二控制码和第一延时码进行调节，或仅对第一延时码进行调节，直至接收到第三沿对沿对齐信号，并输出第二延时码。基于第二延时码确定输入时钟的周期。本发明通过时钟周期检测电路获得输入时钟的周期，无需增加主机的启动流程，使芯片兼容性增强。
主权项：1.一种时钟周期检测方法，其特征在于，应用于时钟周期检测电路中的控制器，所述时钟周期检测电路还包括：延时链、相位插值器和鉴频鉴相器；所述控制器分别与所述相位插值器、鉴频鉴相器和延时链连接，所述延时链还与所述鉴频鉴相器、锁相环连接，所述相位插值器还与所述鉴频鉴相器、锁相环连接；其中，所述锁相环用于输出与输入时钟同频率的多路相位时钟；所述时钟周期检测方法包括以下步骤：输出第一控制码和第一延时码，以使所述相位插值器根据所述第一控制码输出第一相位时钟，并使所述延时链根据所述第一延时码输出第一延时时钟；其中，所述延时链的输入时钟复用所述多路相位时钟里的0°相位时钟；若未接收到第一沿对沿对齐信号，则对所述第一控制码进行累加调节码操作，直至接收到第二沿对沿对齐信号，并输出第二控制码；其中，所述相位插值器根据所述第二控制码输出第二相位时钟；所述第一沿对沿对齐信号表示所述第一相位时钟的上升沿与所述第一延时时钟的上升沿对齐，或所述第一相位时钟的下降沿与所述第一延时时钟的上升沿对齐；所述第二沿对沿对齐信号表示所述第二相位时钟的上升沿与所述第一延时时钟的上升沿对齐，或所述第二相位时钟的下降沿与所述第一延时时钟的上升沿对齐；对所述第二控制码和所述第一延时码进行调节，或仅对所述第一延时码进行调节，直至接收到第三沿对沿对齐信号，并输出第二延时码；基于所述第二延时码确定所述输入时钟的周期。
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百度查询： 成都电科星拓科技有限公司 时钟周期检测方法、装置、电子设备及存储介质
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