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申请/专利权人：凯云联创(北京)科技有限公司
摘要：本申请实施例提供一种FPGA实现硬件逻辑实时仿真的方法及装置，方法包括：将待仿真的算法模型封装成可复用的可编程阵列逻辑器件的算法IP核,并在算法IP核中定义算法模型的输入输出端口和参数接口；通过可编程阵列逻辑器件的预设设计工具将顶层设计文件进行综合布局布线，生成对应的可在可编程阵列逻辑器件上直接运行的比特流文件,并将比特流文件下载至目标硬件平台启动运行；本申请能够有效提升仿真效率和准确性。
主权项：1.一种FPGA实现硬件逻辑实时仿真的方法，其特征在于，所述方法包括：将待仿真的算法模型封装成可复用的可编程阵列逻辑器件的算法IP核,并在所述算法IP核中定义所述算法模型的输入输出端口和参数接口；获取所述可编程阵列逻辑器件的硬件资源描述信息,基于所述算法IP核的输入输出端口和参数接口以及所述可编程阵列逻辑器件的硬件资源描述信息，采用模型驱动方法建立所述输入输出端口和参数接口与所述硬件资源描述信息的映射关系,并根据所建立的映射关系动态生成所述可编程阵列逻辑器件的工程可配置顶层设计文件；通过所述可编程阵列逻辑器件的预设设计工具将所述顶层设计文件进行综合布局布线，生成对应的可在所述可编程阵列逻辑器件上直接运行的比特流文件,并将所述比特流文件下载至目标硬件平台启动运行。
全文数据：
权利要求：
百度查询： 凯云联创(北京)科技有限公司 FPGA实现硬件逻辑实时仿真的方法及装置
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