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申请/专利权人：上海合芯数字科技有限公司;合芯科技有限公司

摘要：本申请提供一种跨电压域的时序路径分析方法、装置、介质及终端，包括：通过对各物理功能模块进行不同电压域分组以形成若干个电压域组别；基于时序分析获取位于不同电压域组别之间的各条时序路径并进行分类以形成若干种时序路径类别；基于仿真分析获取不同类别的各条时序路径在发生电压变化后的约束条件；并根据获取到的约束条件对集成电路中对应的不同电压域组别之间的时序路径进行优化；判断优化后的时序路径是否存在违例。本申请可以在物理设计实现初期获取最差的时序路径情况，降低后期时序收敛的困难，并且可以不依赖有完整的工艺库，较准确地进行时序分析，获得的收敛结果可以实现集成电路更小的面积、更低的功耗、更高的性能速度。

主权项：1.一种跨电压域的时序路径分析方法，适用于集成电路，其特征在于，包括：根据集成电路的电源配置文件获取各物理功能模块的工作电压；根据获取到的各物理功能模块的工作电压，对各物理功能模块进行不同电压域分组以形成若干个电压域组别；基于时序分析获取位于不同电压域组别之间的各条时序路径，并对所述各条时序路径进行分类以形成若干种时序路径类别；包括如下方式：基于时序分析获取位于不同电压域组别之间的各条时钟时序路径，并对所述各条时钟时序路径进行分类，其分类结果包括低电压域组别到高电压域组别的时钟时序路径、高电压域组别到低电压域组别的时钟时序路径；基于仿真分析获取不同类别的各条时序路径在发生电压变化后的约束条件；其中包括如下：利用计算脚本对不同类别的各条时序路径进行计算，以获取所述各条时序路径中电压变化最差的时序路径；确定所述电压变化最差的时序路径的时序裕量，基于仿真分析以获取不同电压域组别之间的各条时序路径在电压发生变化后的约束条件；根据获取到的不同类别的各条时序路径在发生电压变化后的约束条件，对所述集成电路中对应的不同电压域组别之间的时序路径进行优化；包括如下方式：根据获取到的不同类别的各条时序路径在发生电压变化后的约束条件，调整所述集成电路中对应的不同电压域组别之间的时序路径上的组合逻辑元件，以对所述各条时序路径进行优化；基于时序分析判断优化后的时序路径是否存在违例；若存在违例，则执行工程变更命令；若不存在违例，则确定所述时序路径收敛。

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