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申请/专利权人：世强先进(深圳)科技股份有限公司
摘要：本发明涉及一种低频时钟发生器时钟同步输出电路及电子设备。该低频时钟发生器时钟同步输出电路中频率判断单元判断低频时钟发生器产生时钟信号的时钟频率是否小于预设时钟频率；若是，则相位判断单元对所有时钟信号进行延时同步，输出同步时钟信号；若否，则相位判断单元将时钟信号的相位差反馈至低频时钟发生器，低频时钟发生器根据相位差调整时钟相位，时钟相位对齐后输出同步时钟信号。本发明使用FPGA芯片的高速性能对低频时钟发生器的时钟信号进行调整，实现时钟信号的相位对其输出，提高电子设备性能。
主权项：1.一种低频时钟发生器时钟同步输出电路，其特征在于，包括低频时钟发生器（10）和FPGA芯片（20），所述低频时钟发生器（10）的时钟频率小于200MHz；所述低频时钟发生器（10）的时钟信号输出接口连接所述FPGA芯片（20）的第一输入输出接口组，所述低频时钟发生器（10）的I2C接口连接所述FPGA芯片（20）的第二输入输出接口；所述FPGA芯片（20）包括频率判断单元（201）和相位判断单元（202），所述频率判断单元（201）的输入端连接所述第一输入输出接口组，所述频率判断单元（201）的输出端连接所述相位判断单元（202）的第一输入端；所述第二输入输出接口连接所述相位判断单元（202）的第二输入端；所述低频时钟发生器时钟同步输出电路工作原理为：S1、所述频率判断单元（201）判断所述低频时钟发生器（10）产生时钟信号的时钟频率是否小于预设时钟频率；所述频率判断单元（201）存储有所述预设时钟频率；S2、若是，则所述相位判断单元（202）对所有时钟信号进行延时同步，输出同步时钟信号；S3、若否，则所述相位判断单元（202）将时钟信号的相位差反馈至所述低频时钟发生器（10），所述低频时钟发生器（10）根据所述相位差调整时钟相位，时钟相位对齐后输出同步时钟信号。
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