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申请/专利权人：深圳大普微电子股份有限公司

摘要：本申请涉及数据加解密技术领域，公开了一种模乘阵列、数据处理方法及处理终端，该模乘阵列用于对预设的模乘算法进行N轮循环计算，该模乘阵列包括：乘法单元和加法单元，其中，乘法单元包括多个第一乘法器和多个第二乘法器，加法单元包括多个第一加法器，多个第一乘法器和多个第一加法器在每一轮循环计算的过程中并行运算，通过模乘阵列的流水线的硬件设计，使得每轮循环减少一次乘法运算，本申请能够更好地提升模乘运算的效率，进而提高加密效率。

主权项：1.一种模乘阵列，其特征在于，应用于数据加解密领域，所述模乘阵列用于对预设的模乘算法进行N轮循环计算，所述模乘阵列包括：乘法单元和加法单元，其中，所述乘法单元包括多个第一乘法器和多个第二乘法器，所述加法单元包括多个第一加法器，多个第一乘法器和多个第一加法器在每一轮循环计算的过程中并行运算；其中，在第0个时钟周期内，所述乘法单元中的第一乘法器用于根据蒙哥马利域数据，计算第一乘法结果；在第1至N-1个时钟周期内，所述加法单元中的第一加法器用于根据所述第一乘法结果，得到第一加法结果，并对所述第一加法结果进行取低位操作，得到第一低位数据；所述乘法单元中的第二乘法器用于将第一低位数据与第二预计算参数相乘，以得到第一计算结果；所述第一加法器还用于将第一加法结果与第一计算结果进行相加，以得到第二加法结果，并对第二加法结果进行移位操作，得到第一移位结果，进而将第一移位结果与第一乘法结果进行相加，得到第三加法结果，所述乘法单元中的第一乘法器用于根据蒙哥马利域数据，计算第二乘法结果；之后，将本轮的第三加法结果作为下一轮的第一加法结果，将第二乘法结果作为下一轮的第一乘法结果，并重复上述步骤进行循环计算，直至循环计算次数大于或等于N；在第N个时钟周期内，所述加法单元中的第一加法器用于根据所述第N-1个时钟周期得到的第三加法结果和所述第一计算结果，得到第四加法结果，所述乘法单元中的第二乘法器用于对所述第四加法结果进行移位操作，得到第二移位结果，根据所述第二移位结果和所述第二乘法结果，得到第五加法结果，再对所述第五加法结果进行取低位操作，得到第二低位数据，并根据所述第二低位数据和第一预计算参数，得到第三乘法结果；在第N+1个时钟周期内，所述乘法单元中的第一乘法器用于对所述第三乘法结果进行取低位操作，得到第三低位数据，并根据所述第三低位数据和模值，得到第四乘法结果；在第N+2个时钟周期内，所述加法单元中的第一加法器用于根据所述第四加法结果和所述第四乘法结果，得到第六加法结果，并对所述第六加法结果进行移位操作，得到第三移位结果；在第N+3个时钟周期内，所述加法单元中的第一加法器用于对所述第三移位结果进行取模操作，得到模乘运算结果，其中，所述模乘运算结果用于进行数据加密或解密。

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