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申请/专利权人：桂林电子科技大学;南宁桂电电子科技研究院有限公司

摘要：本发明提供了一种结合早期时钟树与H‑tree的时钟树综合优化方法，该方法包括：1提取底层子模块中和本层设计有时序检查关系的时钟延迟信息；2进行常规时钟树综合，提取违例路径以及违例路径的前后级时序裕量；3生成早期时钟树综合约束文件；4进行H‑tree主干的布线；5结合早期时钟树在H‑tree主干结构的基础上进行标准单元布局；6生成常规时钟树综合约束文件；7将需要插入Insertiondelay的时钟叶节点以及插入的相应delay值加入到常规时钟树综合约束文件；8将需要插入insertiondelay的时钟叶节点单独接在一个或多个buffer上；9进行H‑tree子树和有插入延时的叶节点的时钟树综合。本发明有效减少了时钟树的长度以及时钟树的偏差，减小了设计的功耗和时序收敛的难度。

主权项：1.一种结合早期时钟树与H-tree的时钟树综合优化方法，其特征在于，包括如下步骤：步骤1：提取底层子模块中和本层设计有时序检查关系的时钟延迟信息以及相应的时钟端口名称；步骤2：在完成前期的宏单元布局、生成早期时钟树综合约束文件以及标准单元放置之后，进行常规时钟树综合，读取常规时钟树综合时序报告，提取违例路径以及违例路径的前后级时序裕量，并提取需要插入insertiondelay的时钟叶节点名称；步骤3：读入步骤2生成的早期时钟树综合约束文件，设置H-tree主干布线的NDR,创建H-tree主干信息并进行H-tree主干的布线；步骤4：结合早期时钟树在H-tree主干结构的基础上进行布局规划，包括标准单元放置、ICG克隆、ICG位置优化、全局放置优化；步骤5：生成常规时钟树综合约束文件，生成的文件会包含步骤4中克隆的ICG信息；步骤6：将步骤1和步骤2中需要插入Insertiondelay的时钟叶节点以及插入的相应delay值加入到步骤5中生成的常规时钟树综合约束文件中用于指引和约束时钟树综合；步骤7：将步骤6中插入了Insertiondelay的时钟叶节点单独接在一个或多个buffer上，并将该buffer属性设置为stoppin；步骤8：进行H-tree子树和有插入延时的叶节点的时钟树综合。

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