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申请/专利权人：硅实验室公司
摘要：本公开涉及数据延迟补偿器电路。公开一种用于补偿数据延迟的电路。该电路利用内部时钟信号。该内部时钟信号经过IO缓存器以变成外部时钟。然后，该外部时钟经过IO缓存器以创建返回时钟信号。内部时钟信号和返回时钟信号之间的这个差被定义为IO延迟。在某些实施例中，该IO延迟可以是多于一个时钟周期，这通常导致同步逻辑的不正确操作。本电路通过用于捕获和同步返回数据的新颖方法而允许N个时钟周期的IO延迟，其中N大于一。这允许高速微控制器利用较低速度的IO缓存器来减少干扰，或允许这些微控制器与较慢外部设备对接。
主权项：1.一种用于在半导体器件内使用的数据延迟补偿电路，包括：IO缓存器，用于将来自外部设备的返回数据提供到所述半导体器件的内部；时钟IO缓存器电路，用于将内部时钟信号提供到所述半导体器件的外部并且将返回时钟信号提供到所述半导体器件的所述内部；返回数据捕获级，包括：多个捕获触发器，使用所述返回时钟信号来钟控，其中，所述多个是N，其中，每个捕获触发器每N个时钟接收更新的返回数据；返回数据同步级，包括：N个同步触发器，使用所述内部时钟信号来钟控，其中，每个同步触发器每N个时钟从对应的捕获触发器接收更新的数据；复用器，用于选择来自所述N个同步触发器中的一个的输出；以及最终触发器，使用所述内部时钟信号来钟控并且接收来自所述复用器的输出作为输入，其中，所述内部时钟信号与所述返回时钟信号之间的时间差被定义为IO延迟，并且其中，如果所述IO延迟小于N个时钟周期，则从所述内部时钟信号的第一脉冲到来自所述最终触发器的输出有效所在的时刻的时间是确定的，其中N大于一。
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