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申请/专利权人：苏州异格技术有限公司

摘要：本发明涉及现场可编程门阵列技术领域，公开了布尔函数重构求解方法、装置、计算机设备及存储介质，应用于FPGA，包括：获取第一初始查找表、第二初始查找表及约束条件；计算得到第二初始查找表的余子式；遍历第一初始查找表的输入信号与第二初始查找表的输入信号，记录第一初始查找表与第二初始查找表的共享输入信号；确定第一目标查找表与第二目标查找表的输入信号个数分布及对应的输入信号组合；将每一输入信号个数分布及输入信号个数分布对应的输入信号组合输入不同的线程；对各线程进行求解，得到所有的第一目标查找表与第二目标查找表的组合，本发明提升了对FPGA芯片的关键路径延时的优化的运行速度及运行效率，减少了内存消耗。

主权项：1.一种布尔函数重构求解方法，其特征在于，应用于FPGA，所述方法包括：获取第一初始查找表、第二初始查找表及约束条件，所述第一初始查找表的输出信号作为所述第二初始查找表其中一个的输入信号，所述约束条件用于对第一目标查找表与第二目标查找表的输入信号的数量分别进行限制，以及至少一个目标输入信号通过预定的输入端口输入，至少一个所述目标输入信号为所第一目标查找表中的一个或多个输入信号，和或，至少一个所述目标输入信号为所述第二目标查找表中的一个或多个输入信号；所述第一目标查找表的输出信号作为到所述第二目标查找表其中一个的输入信号；基于所述第一初始查找表的输出信号、与所述输出信号对应的所述第二初始查找表的输入的比特位、预先构建的掩码表、所述第二初始查找表的真值表、所述第二初始查找表的输入信号的个数，计算得到所述第二初始查找表的余子式；分别遍历所述第一初始查找表的输入信号与所述第二初始查找表的输入信号，记录所述第一初始查找表与所述第二初始查找表的共享输入信号；基于所述第一初始查找表的输入信号、所述第二初始查找表的输入信号与所述约束条件，确定所述第一目标查找表与所述第二目标查找表的输入信号个数分布及输入信号个数分布对应的输入信号组合；将每一所述输入信号个数分布及输入信号个数分布对应的输入信号组合输入不同的线程；基于所述第二初始查找表的余子式、所述第一初始查找表与所述第二初始查找表的共享输入信号，对各所述线程进行多线程求解，得到所有的所述第一目标查找表与所述第二目标查找表的组合，以利用所有的所述第一目标查找表与所述第二目标查找表的组合实现FPGA关键路径延时的优化。

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百度查询： 苏州异格技术有限公司 布尔函数重构求解方法、装置、计算机设备及存储介质