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申请/专利权人：致真存储(北京)科技有限公司

摘要：本申请提供了一种存算一体运算电路，涉及集成电路技术领域，包括：存储阵列、参考阵列、运算放大器、比例放大模块以及存储模块；运算放大器的第一输入端与存储阵列的输出端相连接，第二输入端与参考阵列的输出端和比例放大模块的第一端相连接，输出端与比例放大模块的第二端连接，比例放大模块的第三端与存储模块相连接。运算放大器用于对存储阵列根据输入信号生成的输出信号阵列，以及参考阵列根据输入信号生成的参考信号阵列进行比较后，得到比较信号阵列。比例放大模块用于根据输入信号的运算周期，对比较信号阵列进行对应比例的加权，得到运算信号阵列。存储模块，用于存储不同运算周期的运算信号阵列。该电路结构简单，运算精度高。

主权项：1.一种存算一体运算电路，其特征在于，所述电路包括：存储阵列模块、参考阵列模块、运算放大器、比例放大模块以及数据存储模块；所述运算放大器的第一输入端与所述存储阵列模块的输出端相连接，第二输入端与所述参考阵列模块的输出端和所述比例放大模块的第一端相连接，所述运算放大器的输出端与所述比例放大模块的第二端相连接，所述比例放大模块的第三端和所述数据存储模块相连接；所述运算放大器用于根据所述存储阵列模块基于输入信号生成的输出信号阵列，以及所述参考阵列模块用于基于输入信号生成的参考信号阵列生成比较信号阵列，其中，所述存储阵列模块存储有多个表征为不同阻态的第一电阻，所述输出信号阵列为所述输入信号与所述第一电阻进行运算后得到的信号阵列；所述参考阵列模块存储有多个与所述第一电阻一一对应的第二电阻，所述参考信号阵列为所述输入信号与所述第二电阻进行运算后得到的信号阵列；所述比例放大模块包括比例放大单元和比例调整单元；所述比例放大单元的第一端与所述运算放大器的第二输入端连接，第二端与所述运算放大器的输出端连接，用于根据所述输入信号的运算周期，对所述比较信号阵列进行第一对应比例的放大，得到放大信号阵列；所述比例调整单元的第一端与所述运算放大器的输出端连接，第二端与所述存储模块相连接，用于根据所述输入信号的运算周期，对所述放大信号阵列进行第二对应比例的调整，得到运算信号阵列；所述数据存储模块，用于存储不同运算周期的所述运算信号阵列。

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