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龙图腾网恭喜北京奕斯伟计算技术股份有限公司;广州全盛威信息技术有限公司申请的专利分频器及其控制方法、时钟信号生成电路和电子设备获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN113162619B 。

龙图腾网通过国家知识产权局官网在2025-03-07发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202110473522.3，技术领域涉及：H03L7/181；该发明授权分频器及其控制方法、时钟信号生成电路和电子设备是由杨新;冯奎景;严迪超设计研发完成，并于2021-04-29向国家知识产权局提交的专利申请。

本分频器及其控制方法、时钟信号生成电路和电子设备在说明书摘要公布了：本申请提供了一种分频器及其控制方法、时钟信号生成电路和电子设备。该分频器包括：第一信号发生单元生成包括至少一个第一信号的第一信号序列，时钟信号序列的每组时钟信号包括2n+1个时钟信号；第一信号的跳变沿，与一组时钟信号的第n+2个时钟信号的跳变沿对应；反相单元；第二信号发生单元生成包括至少一个第二信号的第二信号序列，第二信号中，跳变沿与一组反相时钟信号中第1个反相时钟信号的跳变沿对应，反相跳变沿与第n+1个反相时钟信号的跳变沿对应；组合逻辑单元对第一信号序列和第二信号序列做组合逻辑运算；二分频单元用于生成等占空比的2n+1分频信号序列。本申请能够降低竞争冒险的几率，降低产生信号毛刺几率。

本发明授权分频器及其控制方法、时钟信号生成电路和电子设备在权利要求书中公布了：1.一种分频器，其特征在于，包括：第一信号发生单元，用于根据时钟信号序列，生成包括至少一个第一信号的第一信号序列并输出；所述时钟信号序列的每组时钟信号包括2n+1个时钟信号，n为正整数；所述第一信号的跳变沿，与一组所述时钟信号的第n+2个时钟信号的跳变沿对应；反相单元；第二信号发生单元，输入端与所述反相单元的输出端电连接，用于根据与所述时钟信号序列相位相反的反相时钟信号序列，生成包括至少一个第二信号的第二信号序列并输出；所述第二信号中，跳变沿与一组反相时钟信号中第1个反相时钟信号的跳变沿对应，反相跳变沿与第n+1个反相时钟信号的跳变沿对应；组合逻辑单元，两个输入端分别与所述第一信号发生单元和第二信号发生单元的输出端电连接，对所述第一信号序列和所述第二信号序列做组合逻辑运算，得到包括至少两个第三信号的第三信号序列并输出；二分频单元，输入端与所述组合逻辑单元的输出端电连接，用于根据所述第三信号序列，生成等占空比的2n+1分频信号序列；其中，所述组合逻辑单元对所述第一信号序列和所述第二信号序列做或非逻辑运算以生成所述第三信号序列；或者，所述组合逻辑单元对所述第一信号序列和所述第二信号序列做与逻辑运算以生成所述第三信号序列；所述二分频单元包括触发器和反相器；所述触发器的时钟端，作为所述二分频单元的输入端，与所述组合逻辑单元的输出端电连接，用于接收所述第三信号序列；所述反相器的正极、负极，与所述触发器的输出端、输入端电连接；所述触发器用于通过时钟端接收到相邻两个所述第三信号中的一个所述第三信号的跳变沿时，通过输出端输出等占空比的2n+1分频信号序列中一个2n+1分频信号的第一电位，并通过输入端接收被所述反相器反相的第二电位；接收到紧接的另一个所述第三信号的跳变沿时，输出所述2n+1分频信号的第二电位。

如需购买、转让、实施、许可或投资类似专利技术，可联系本专利的申请人或专利权人北京奕斯伟计算技术股份有限公司;广州全盛威信息技术有限公司，其通讯地址为：100176 北京市大兴区北京经济技术开发区科创十四街99号33幢D栋2层2179号(集中办公区)；或者联系龙图腾网官方客服，联系龙图腾网可拨打电话0551-65771310或微信搜索“龙图腾网”。