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龙图腾网恭喜美新半导体(天津)有限公司申请的专利一种数字通讯总线电平检测电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN112798852B 。

龙图腾网通过国家知识产权局官网在2025-04-04发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202110145178.5，技术领域涉及：G01R19/00；该发明授权一种数字通讯总线电平检测电路是由金羊华;黄黎;丁希聪;刘尧;蒋乐跃设计研发完成，并于2021-02-02向国家知识产权局提交的专利申请。

本一种数字通讯总线电平检测电路在说明书摘要公布了：本发明提供一种数字通讯总线电平检测电路，其包括：外部端口；内部串行时钟引脚；内部串行数据引脚；第一上拉电阻，其连接于内部串行时钟引脚和外部端口之间；第二上拉电阻，其连接于内部串行数据引脚和外部端口之间；电平检测器，其用于检测内部串行时钟引脚或内部串行数据引脚的高电平，并将检测到的该高电平作为参考高电平；波形整形电路，其以参考高电平作为逻辑高电平，对外部串行数据信号进行整形以得到外部串行数据信号，对外部串行时钟信号进行整形以得到外部串行时钟信号。与现有技术相比，本发明可以在内外部间形成正确的通讯交流，其既不需要额外的接口电源管脚，又节省了芯片面积。

本发明授权一种数字通讯总线电平检测电路在权利要求书中公布了：1.一种数字通讯总线电平检测电路，其特征在于，其包括：外部端口（1），其与外部端口电源（VDDIO）相连；内部串行时钟引脚（2），其与外部串行时钟线（SCL）相连，以接收外部串行时钟信号（SCL）；内部串行数据引脚（3），其与外部串行数据线（SDA）相连，以接收外部串行数据信号（SDA）；第一上拉电阻（R1），其连接于所述内部串行时钟引脚（2）和外部端口（1）之间；第二上拉电阻（R2），其连接于所述内部串行数据引脚（3）和外部端口（1）之间；电平检测器，其用于检测所述内部串行时钟引脚（2）或所述内部串行数据引脚（3）的高电平，并将检测到的该高电平作为参考高电平（VDT），所述参考高电平（VDT）通过所述电平检测器的第一输出端输出；波形整形电路，其第一输入端接收所述外部串行时钟信号（SCL），其第二输入端接收所述外部串行数据信号（SDA），其第三输入端接收所述参考高电平（VDT），所述波形整形电路以所述参考高电平（VDT）作为逻辑高电平，对所述外部串行数据信号（SDA）进行整形以得到矩形脉冲，该矩形脉冲即为整形后的外部串行数据信号（SDAP），对所述外部串行时钟信号（SCL）进行整形以得到矩形脉冲，该矩形脉冲即为整形后的外部串行时钟信号（SCLP）；电平转换电路，其第一输入端与所述整形后的外部串行时钟信号（SCLP）相连，其第二输入端与所述整形后的外部串行数据信号（SDAP）相连，其电源端与内部通讯电路的电源（VDD）相连，所述电平转换电路以所述内部通讯电路的电源（VDD）作为逻辑高电平，对所述整形后的外部串行数据信号（SDAP）进行电平转换以得到内部串行数据信号（SDAin），对所述整形后的外部串行时钟信号（SCLP）进行电平转换以得到内部串行时钟信号（SCLin），其中，所述内部串行数据信号（SDAin）与所述内部通讯电路中的内部串行数据线相连，所述内部串行时钟信号（SCLin）与所述内部通讯电路中的内部串行时钟线相连；所述电平检测器的第一输入端与所述内部串行时钟引脚（2）相连，以接收所述外部串行时钟信号（SCL），所述电平检测器的第二输入端与所述内部串行数据引脚（3）相连，以接收外部串行数据信号（SDA）；所述电平检测器的第二输出端输出其第一输入端接收到的所述外部串行时钟信号（SCL），其第三输出端输出其第二输入端接收到的所述外部串行数据信号（SDA）；所述整形电路的第一输入端与所述电平检测器的第二输出端相连，以接收所述外部串行时钟信号（SCL）；所述整形电路的第二输入端与所述电平检测器的第三输出端相连，以接收所述外部串行数据信号（SDA）。

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