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龙图腾网恭喜上海复旦微电子集团股份有限公司申请的专利一种基于时延数据库的快速FPGA时延评估方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN114548010B 。

龙图腾网通过国家知识产权局官网在2025-06-10发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202011304817.X，技术领域涉及：G06F30/347；该发明授权一种基于时延数据库的快速FPGA时延评估方法是由杨琼华;王似飞;钱港;陈建利;徐烈伟;吴昌设计研发完成，并于2020-11-19向国家知识产权局提交的专利申请。

本一种基于时延数据库的快速FPGA时延评估方法在说明书摘要公布了：本发明提供一种基于时延数据库的快速FPGA时延评估方法，所述方法包含：获取单元间线网所覆盖线段的路径信息、所述线段的电阻电容信息；基于所述路径信息、电阻电容信息获取线网配置信息；获取线网两端的起点单元与终点单元的相对坐标x,y；根据所述线网配置信息、相对坐标建立若干个时延表，包含：时钟表、差分表、路径表、附加时延表、基本时延表、引脚表；根据线网类型、线网两端单元的相对坐标，通过查表计算得到线网两端的时延。本发明能够快速评估线网时延，评估结果准确可靠，且不需占用大量计算资源。

本发明授权一种基于时延数据库的快速FPGA时延评估方法在权利要求书中公布了：1.一种基于时延数据库的快速FPGA时延评估方法，FPGA芯片包含按阵列方式设置的若干个单元，任意两个单元之间通过线网连接，其特征在于，所述方法包含：获取单元间线网所覆盖线段的路径信息、所述线段的电阻电容信息；基于所述路径信息、电阻电容信息获取线网配置信息；获取线网两端的起点单元与终点单元的相对坐标x,y；根据所述线网配置信息、相对坐标建立若干个时延表，包含：时钟表、差分表、路径表、附加时延表、基本时延表、引脚表；根据线网类型、线网两端单元的相对坐标，通过查表计算得到线网两端的时延Delaynet；所述配置信息包含线网类型，所述线网类型包含：时钟线网、非时钟线网；当线网为时钟线网，所述配置信息包含：与时钟线网对应的时钟类型Clocktype、时延值Delayclock；所述时钟表包含若干个键值对，所述键值对包含所述时钟类型Clocktype和对应的时延值Delayclock；根据时钟线网的时钟类型Clocktype查找时钟表，得到该线网两端的时延Delaynet＝Delayclock；非时钟线网的配置信息包含：线网起点单元源引脚标志IDsource、线网起点单元类型Typesource、线网起点单元源引脚自身的时延值Delaysourceintrincpin、线网起点单元源引脚到该起点单元相邻的布线Tile的时延值Delayclbtoint；所述引脚表包含若干个第一四元组，一个第一四元组对应一个线网；所述第一四元组包含：线网起点单元源引脚标志IDsource、线网起点单元类型Typesource、线网起点单元源引脚自身的时延值Delaysourceintrincpin、线网起点单元源引脚到该起点单元相邻的布线Tile的时延值Delayclbtoint；非时钟线网的配置信息还包含：线网终点单元漏引脚标志IDsink、线网终终单元的类型Typesink、线网终点单元漏引脚自身的时延值Delaysinkintrincpin、线网终点单元漏引脚到该终点单元相邻的布线Tile的时延值Delayinttoclb；所述引脚表包含若干个第二四元组，一个第二四元组对应一个线网；所述第二四元组包含：线网终点单元漏引脚标志IDsink、线网终点单元的类型Typesink、线网终点单元漏引脚自身的时延值Delaysinkintrincpin、线网终点单元相邻的布线Tile到该终点单元漏引脚的时延值Delayinttoclb；非时钟线网的配置信息还包含：线网的附加时延值Delayadd，Delayadd＝Delayx_dir_add+Delayy_dir_add；令xbase、ybase分别为预设的在X、Y轴方向的线长阈值，x、y分别为相对坐标x,y的横坐标和纵坐标；令Delayx_base为线长为xbase的线段在X轴方向的时延值，Delayy_base为线长为ybase的线段在Y轴方向的时延值，Delayx_dir_add＝Delayx_base*numx，Delayy_dir_add＝Delayy_base*numy；所述附加时延表包含若干个第三四元组，一个第三四元组对应一个线网；所述第三四元组包含：线网起点单元源引脚标志IDsource，线网终点单元漏引脚标志IDsink，线网两端起点单元与终点单元相对坐标x,y，附加时延值Delayadd；非时钟线网的配置信息还包含：线网的基本时延值Delaybase，Delaybase＝Delayx_dir_base+Delayy_dir_base；lenx≡xmodxbase，leny≡ymodybase，Delayx_dir_base、Delayy_dir_base分别表示在X、Y轴，长为lenx、leny的线段的时延值；所述基本时延表包含若干个第四四元组，一个第四四元组对应一个线网；所述第四四元组包含：线网起点单元源引脚标志IDsource，线网终点单元漏引脚标志IDsink，线网两端起点单元与终点单元相对坐标x,y，基本时延值Delaybase；非时钟线网的配置信息还包含：线网的路径信息，所述路径信息包含线网路径不同位置所跨越Tile的Tile类型Tiletype；所述路径表中存有若干组路径信息，一组路径信息对应一个线网；所述线网路径所跨越的Tile按照Tile类型被分为第一组和第二组；线网跨越第一组的任一Tile所产生的时延超过设定的基准时延值Timebase，超过基准时延值的时延记为该Tile的差分时延值；非时钟线网的配置信息还包含：基准时延值Timebase、Tile类型Tiletype、Tile在线网的位置信息，与Tile类型Tiletype及所述位置信息对应的差分时延值Delaydiff；所述差分表包含若干个第五四元组，一个第五四元组对应一个Tile，且该Tile为所述第一组的Tile；所述第五四元组包含：基准时延值Timebase，Tile类型Tiletype，Tile在线网的位置信息，与Tile类型Tiletype、Tile在线网的位置信息对应的差分时延值Delaydiff；计算非时钟线网的时延包含步骤：S1、基于线网起点单元源引脚标志IDsource、线网起点单元类型Typesource查找引脚表，得到线网起点单元源引脚自身的时延值Delaysourceintrincpin、线网起点单元源引脚到该起点单元相邻的布线Tile的时延值Delayclbtoint；计算得到线网起点单元源引脚时延值Delaysourcepin＝Delaysourceintrincpin+Delayclbtoint；基于线网终点单元漏引脚标志IDsink、线网终点单元的类型Typesink查找表，得到线网终点单元漏引脚自身的时延值Delaysinkintrincpin、线网终点单元相邻的布线Tile到该终点单元漏引脚的时延值Delayinttoclb；计算得到线网终点单元漏引脚时延值Delaysinkpin＝Delaysinkintrincpin+Delayinttoclb；计算线网两端引脚时延值Delaypin＝Delaysourcepin+Delaysinkpin；S2、基于线网起点单元源引脚标志IDsource、线网终点单元漏引脚标志IDsink、线网两端起点单元与终点单元相对坐标x,y查找附加时延表，得到线网的附加时延值Delayadd；S3、基于线网起点单元源引脚标志IDsource、线网终点单元漏引脚标志IDsink、线网两端起点单元与终点单元相对坐标x,y，查找基本时延表，获取线网基本时延值Delaybase；S4、查找路径表，获取线网路径，线网路径不同位置所跨的Tile类型Tiletype，若Tiletype属于所述第一组，基于线网所跨越Tile的类型Tiletype、该Tile在线网的位置查找差分表，得到该Tile的差分时延值Delaydiff；重复步骤S4，直到获得该线网跨越的所有属于第一组的Tile的差分时延值并求和，得到线网的差分时延值Delaynetdiff＝∑Delaydiff；S5、计算得到线网两端的时延Delaynet＝Delaypin+Delaybase+Delayadd+Delaynetdiff。

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