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一种基于FPGA的SRIO高速总线的通讯系统 

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申请/专利权人:苏州长风航空电子有限公司

摘要:本申请提供了一种基于FPGA的SRIO高速总线的通讯系统,具体包括寄存器和中断控制模块,用于对事务类型和数据信息进行配置,给出反馈信号;SRIO源端模块,用于解析事务类型和数据信息,并发起对应的事务,产生NREAD中断和读写寄存器状态变化,产生事务请求,以及接收NREAD事务和DOORBELL事务请求接收端发来的响应;SRIO目的端模块,用于接收SRIO源端模块的事务请求并发送响应数据,产生DOORBELL寄存器状态变化和DOORBELL中断;SerialRapidIOGen2EndpointIP模块,用于实现SRIO源端模块和SRIO目的端模块的SRIO逻辑层、物理层、传输层协议;DMA模块,用于对数据进行存取。通过本申请的处理方案,最大限度的发挥SRIO串行数据总线的速度,提高系统实时性。

主权项:1.一种基于FPGA的SRIO高速总线的通讯系统,其特征在于,包括:寄存器和中断控制模块,用于对事务类型和数据信息进行配置,给出反馈信号;SRIO源端模块,与所述寄存器和中断控制模块通信连接,用于解析所述事务类型和数据信息,并发起对应的事务,产生NREAD中断和读写寄存器状态变化;产生事务请求,以及接收NREAD事务和DOORBELL事务请求接收端发来的响应;SRIO目的端模块,用于接收所述SRIO源端模块的事务请求并发送响应数据,产生DOORBELL寄存器状态变化和DOORBELL中断;SerialRapidIOGen2EndpointIP模块,与所述SRIO源端模块和所述SRIO目的端模块分别通讯连接,用于实现SRIO逻辑层、物理层、传输层协议;DMA模块,分别与所述SRIO源端模块和所述SRIO目的端模块通信连接,用于对数据进行存取。

全文数据:

权利要求:

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