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申请/专利权人：哈尔滨工业大学

摘要：本发明是一种基于FPGA的CoaXPress接口数据到CameraLink接口数据的高速实时转换装置及方法。本发明涉及星载高速数据传输技术技术领域，所述装置包括：FPGA、CoaXpress接口和CameraLink接口；CoaXpress接收通路的接口连接器能够接收两路信号，分别通过两个CoaXpress接口芯片与FPGA通信；CameraLink80bit发送通路使用三片接口芯片连接到两个CameraLink接口连接器。本发明采用基于BlockRAM的乒乓缓存的读写方式，相比片外缓存传输延时更低，保障了高速数据传输的实时性。

主权项：1.一种使用基于FPGA的CoaXPress接口数据到CameraLink接口数据的高速实时转换装置进行CoaXPress接口数据到CameraLink接口数据的高速实时转换方法，其特征是：所述方法包括：步骤1：通过使用FPGA内部的混合模式时钟管理器提供不同的时钟源，其中，数据接收部分使用的drp_clk时钟频率为100MHz，数据解码和数据转换部分使用的sys_clk为250MHz，数据转换部分使用的cam_clk为85MHz；步骤2：数据接收部分由GTH-Aurora8b10b串行转换模块和GTH读写模块组成，GTH-Aurora8b10b串行转换模块接收分别来自两片CoaXPress接口芯片的两对高速串行差分信号，同时接收来自板载晶振输出的125MHz差分时钟，串行转换模块从高速串行差分提取出有效的并行数据，同时提取出包含数据时钟和K码信息的控制信息；步骤3：数据解码包含gth0解码模块、gth1解码模块和数据同步模块，gth0和gth1负责接收数据时钟、数据和控制K码，在数据时钟下根据控制K码包含的信息提取出有效的图像数据data0和data1；步骤4：数据转换包含数据转换缓存模块和CameraLink80bit发送模块，数据转换缓存模块内部通过一个状态机进行控制两个BlockRAM进行乒乓读写，每个BlockRAM各缓存一行的图像数据，由状态机控制交替进行读或写；步骤5：当第n行图像数据正在写入一个BlockRAM时，另一个BlockRAM发送第n-1行的数据，发送时间为相机行频的倒数，传输一行图像的时间，转换功能体现在对BlockRAM进行乒乓缓存的同时，通过覆写BlockRAM的地址实现图像数据的拼接操作和图像辅助数据的转换操作，传输延时最大程度保证高速传输的实时性；所述基于FPGA的CoaXPress接口数据到CameraLink接口数据的高速实时转换装置包括：FPGA、CoaXpress接口和CameraLink接口；CoaXpress接收通路的接口连接器能够接收两路信号，分别通过两个CoaXpress接口芯片与FPGA通信；CameraLink80bit发送通路使用三片接口芯片连接到两个CameraLink接口连接器。

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