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【发明公布】一种PBIT前后台程序读写外设数据时序冲突处理方法_中国航空工业集团公司西安飞行自动控制研究所_202410201260.9 

申请/专利权人:中国航空工业集团公司西安飞行自动控制研究所

申请日:2024-02-23

公开(公告)日:2024-05-31

公开(公告)号:CN118113502A

主分类号:G06F11/07

分类号:G06F11/07;G06F11/22

优先权:

专利状态码:在审-公开

法律状态:2024.05.31#公开

摘要:本申请提供了一种PBIT前后台程序读写外设数据时序冲突处理方法,所述方法包括:识别出后台程序和前台中断程序同时访问数据的PBIT测试项;若所述PBIT测试项和所述前台中断程序同时访问加解锁地址,所述后台程序访问加解锁地址,在操作过程中需禁止所述前台中断程序;若所述PBIT测试项和所述前台中断程序同时访问外设总线,所述后台程序访问外设总线,需操作过程中需禁止所述前台中断程序,同时读写总线之后,延时时间超过总线发送接收时间;本申请能够解决PBIT频繁误报故障,提高PBIT的安全性和可靠性。

主权项:1.一种PBIT前后台程序读写外设数据时序冲突处理方法,其特征在于,所述方法包括:识别出后台程序和前台中断程序同时访问数据的PBIT测试项;若所述PBIT测试项和所述前台中断程序同时访问加解锁地址,所述后台程序访问加解锁地址,在操作过程中需禁止所述前台中断程序;若所述PBIT测试项和所述前台中断程序同时访问外设总线,所述后台程序访问外设总线,需操作过程中需禁止所述前台中断程序,同时读写总线之后,延时时间超过总线发送接收时间。

全文数据:

权利要求:

百度查询: 中国航空工业集团公司西安飞行自动控制研究所 一种PBIT前后台程序读写外设数据时序冲突处理方法

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1、本报告根据公开、合法渠道获得相关数据和信息,力求客观、公正,但并不保证数据的最终完整性和准确性。
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