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一种克服死区输入的逐次逼近型模数转换器 

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申请/专利权人:珠海昇生微电子有限责任公司

摘要:本发明提供一种克服死区输入的逐次逼近型模数转换器,其包括放大倍数可控的AMP缓冲电路、SARADC电路、数字控制校准逻辑电路、数字寄存器,AMP缓冲电路的输入端接入外部输入信号,AMP缓冲电路的输出端与SARADC电路的一个输入端连接,SARADC电路的另一个输入端接共模搬移电平信号,SARADC电路的输出端与数字控制校准逻辑电路连接,AMP缓冲电路的控制端与数字控制校准逻辑电路连接;数字控制校准逻辑模块用于将第一次ADC采样后的数据与预先设置好的参考码值进行比较判断,根据判断结果来选择是否调整AMP缓冲电路的放大倍数并进行二次采样,最后根据调整后的AMP值进行数据校准。应用本发明可以有效克服死区电压无法输出的问题。

主权项:1.一种克服死区输入的逐次逼近型模数转换器,其特征在于,包括:放大倍数可控的AMP缓冲电路、SARADC电路、数字控制校准逻辑电路、数字寄存器,所述AMP缓冲电路的输入端接入外部输入信号,所述AMP缓冲电路的输出端与所述SARADC电路的一个输入端连接,所述SARADC电路的另一个输入端接共模搬移电平信号,所述SARADC电路的输出端与所述数字控制校准逻辑电路连接,所述AMP缓冲电路的控制端与所述数字控制校准逻辑电路连接,所述数字控制校准逻辑电路与所述数字寄存器连接;其中,所述AMP缓冲电路的放大倍数可调,用于针对不同的电压输入范围,设置相应的AMP值;其中,所述数字控制校准逻辑模块用于将第一次ADC采样后的数据与预先设置好的参考码值进行比较判断,根据判断结果来选择是否调整所述AMP缓冲电路的放大倍数并进行二次采样,最后根据调整后的AMP值进行数据校准,并将数据存储至所述数字寄存器内。

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权利要求:

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