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申请/专利权人：本源量子计算科技(合肥)股份有限公司
申请日：2022-01-27
公开（公告）日：2024-06-14
公开（公告）号：CN115469711B
主分类号：G06F1/02
分类号：G06F1/02;G06N10/20
优先权：
专利状态码：有效-授权
法律状态：2024.06.14#授权;2023.06.16#著录事项变更;2022.12.30#实质审查的生效;2022.12.13#公开
摘要：本发明公开了正余弦信号发生器、存储器及量子计算机控制系统。正余弦信号发生器包括地址获取模块和存储器，存储器存储有第一数量的预设频率的正弦值和余弦值：地址获取模块用于在工作时钟作用下依次获取以预设步长递增的查表地址，并送入存储器；存储器被配置为每送入一个查表地址时，分别并行输出第二数量的用于分别形成正弦信号和余弦信号的当前正弦值和当前余弦值；其中，每次输出的正弦值和余弦值的相位以预设相位增量递增，相邻两次输出的正弦值和余弦值在相位上连续，预设相位增量根据预设频率、第一数量、第二数量和工作时钟的频率确定。通过上述方式，本发明能够在FPGA内生成较高频率的正余弦信号，可以降低资源消耗和成本。
主权项：1.一种正余弦信号发生器，用于FPGA，其特征在于，包括地址获取模块和存储器，所述存储器存储有第一数量的预设频率的正弦值和余弦值：所述地址获取模块用于在工作时钟作用下依次获取以预设步长递增的查表地址，并送入存储器；所述存储器被配置为每送入一个查表地址时，分别并行输出第二数量的用于分别形成正弦信号和余弦信号的当前正弦值和当前余弦值；其中，每次输出的正弦值和余弦值的相位以预设相位增量递增，相邻两次输出的正弦值和余弦值在相位上连续，所述预设相位增量根据所述预设频率和所述工作时钟的频率的比值与所述第一数量和所述第二数量的比值的乘积确定。
全文数据：
权利要求：
百度查询： 本源量子计算科技(合肥)股份有限公司 正余弦信号发生器、存储器及量子计算机控制系统
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