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具有正确舍入的混合精度浮点数的融合乘加运算器 

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申请/专利权人:卡雷公司

摘要:本发明涉及融合乘加硬件运算器包括:乘法器,接收作为以第一精度格式编码的浮点数的两个被乘数;与乘法器相关的对准电路,配置为基于被乘数的指数,将乘法结果转换成具有足够位数以覆盖乘法的整个动态范围的第一固定点数;以及加法器,配置为将第一固定点数和加法操作数相加。加法操作数是以具有比第一精度格式更高精度的第二精度格式编码的浮点数,且运算器包括与加法操作数相关的对准电路,其被配置为基于加法操作数的指数,将加法操作数转换为相对于加法操作数的动态范围的减小的动态范围的第二固定点数,第二固定点数的位数等于第一固定点数的位数在两侧至少扩展了加法操作数的尾数大小;并且加法器配置为无损失地将第一和第二固定点数相加。

主权项:1.一种融合乘加硬件运算器,包括:乘法器,接收作为以第一精度格式编码的浮点数的两个被乘数;与所述乘法器相关联的对准电路,其被配置为基于所述被乘数的指数,将乘法的结果转换成具有足够位数以覆盖乘法的整个动态范围的第一固定点数;以及加法器,被配置为将所述第一固定点数和加法操作数相加;其中,所述加法操作数是以具有比所述第一精度格式更高的精度的第二精度格式编码的浮点数,并且其中:所述运算器包括与所述加法操作数相关联的对准电路,所述对准电路被配置为基于所述加法操作数的指数,将所述加法操作数转换成相对于所述加法操作数的动态范围的减小的动态范围的第二固定点数,所述第二固定点数的位数等于第一固定点数的位数在两侧至少扩展了所述加法操作数的尾数的大小;并且所述加法器被配置为无损失地将所述第一固定点数和所述第二固定点数相加。

全文数据:

权利要求:

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