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申请/专利权人：杭州缘及科技有限公司

摘要：一种移位寄存时钟生成器，包括:锁存单元用于对第一电平信号进行锁存，并释放锁存的第一电平信号；信号跳变单元用于在锁存单元接收到第一电平信号之前对第二电平信号进行逻辑处理得到第三电平信号，并在接收到释放的第一电平信号时对第一电平信号进行逻辑处理得到第四电平信号，以生成跳变信号；脉冲信号生成单元用于根据跳变信号生成第一时钟脉冲信号以及第二时钟脉冲信号，第一时钟脉冲信号输入到两级移位寄存器中的后一级移位寄存器，第二时钟脉冲信号输入到两级移位寄存器中的前一级移位寄存器，第二时钟脉冲信号相对于第一时钟脉冲信号的延迟时间大于等于后一级移位寄存器的保持时间。

主权项：1.一种移位寄存时钟生成器，其特征在于，包括：锁存单元，用于对第一电平信号进行锁存，并释放锁存的所述第一电平信号；信号跳变单元，用于在所述锁存单元接收到所述第一电平信号之前对第二电平信号进行逻辑处理得到第三电平信号，并在接收到释放的所述第一电平信号时对所述第一电平信号进行逻辑处理得到第四电平信号，以生成跳变信号，其中所述第一电平信号与所述第二电平信号互为反相信号，所述第三电平信号与所述第四电平信号互为反相信号；脉冲信号生成单元，用于根据所述跳变信号生成第一时钟脉冲信号以及第二时钟脉冲信号，所述第一时钟脉冲信号输入到两级移位寄存器中的后一级移位寄存器，所述第二时钟脉冲信号输入到所述两级移位寄存器中的前一级移位寄存器，所述第二时钟脉冲信号相对于所述第一时钟脉冲信号的延迟时间大于等于所述后一级移位寄存器的保持时间；其中，所述信号跳变单元包括反馈子单元以及切沿子单元，所述反馈子单元用于保持所述第四电平信号，所述切沿子单元用于对第一电平信号进行切沿得到所述第四电平信号；其中，还包括：输入单元，用于根据时钟源信号生成所述第一电平信号以及所述第二电平信号；其中，所述输入单元包括H级反相器，所述H级反相器中的R级反相器对所述时钟源信号进行偶数次反相处理，得到第一电平信号；所述H级反相器中的S级反相器对所述时钟源信号进行奇数次反相处理，得到第二电平信号；H为大于或等于2的正整数，R、S为大于或等于1的正整数，其中，若H为偶数，则S小于H，且R小于或等于H；若H为奇数，则R小于H，且S小于或等于H；其中，当H＝2，R＝2，S＝1时，所述输入单元包括：第一反相器以及第二反相器，所述第一反相器包括第七PMOS管以及第八NMOS管，所述第七PMOS管的栅极与第八NMOS管的栅极连接并形成所述第一反相器的输入端，所述第七PMOS管的源极与电源连接，所述第七PMOS管的漏极与第八NMOS管的漏极连接并形成所述第一反相器的输出端，所述第八NMOS管的源极接地；所述第二反相器包括第九PMOS管以及第十NMOS管，所述第九PMOS管的栅极与第十NMOS管的栅极连接并形成所述第二反相器的输入端，所述第二反相器的输入端与所述第一反相器的输出端连接，所述第九PMOS管的源极与电源连接，所述第九PMOS管的漏极与第十NMOS管的漏极连接并形成所述第二反相器的输出端，所述第十NMOS管的源极接地。

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