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申请/专利权人：桂林电子科技大学
摘要：本发明涉及一种延迟锁相环多相位时钟信号延迟失配校准系统及方法，用于解决延迟锁相环多相位时钟相邻输出时钟相位延迟差存在失配的问题。所述系统及方法包括：多相时钟发生电路、数字时间转换电路、多路选择电路、鉴相电路与数字相位校准模块。所述多相时钟发生电路产生多个周期相同的时钟信号，且每个输出时钟信号之间有特定的延迟；所述数字时间转换器电路通过数字控制方式改变每个输出时钟信号的延迟时间大小；所述多路选择器在校准单元控制下选择相邻两个数字时间转换器的输出信号进行输出；所述鉴相器电路比较多路选择器输出信号间的相位误差；数字相位校准模块基于鉴相器电路比较结果对各数字时间转换器的延迟时长进行调整。
主权项：1.一种延迟锁相环多相位时钟信号延迟失配校准系统，用于校准多相时钟输出时两相邻相位时钟延迟差，其特征在于，包括：待校准的多相时钟100、多个数字时间转换电路200、多路选择电路300_1、300_2、补偿延迟链电路101_1_2、鉴相电路400和数字相位校准模块500；所述待校准的多相时钟100产生多个周期相同的时钟信号，且每个输出时钟信号之间有特定的延迟；所述多个数字时间转换电路200通过数字信号输入改变经由数字时间转换电路200产生延迟的大小；所述多路选择电路300_1、300_2在数字信号控制下选择将指定的输入端口的电平状态输出；所述补偿延迟链电路101_1_2产生与所述待校准的多相时钟100中第一与第二输出相位间大小相同的延迟；所述鉴相电路400用于判别两个输入信号的相位差；所述数字相位校准模块500基于鉴相结果产生各个数字时间转换电路200与多路选择电路300_1、300_2的数字控制信号。
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百度查询： 桂林电子科技大学 一种延迟锁相环多相位时钟信号延迟失配校准系统及方法
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