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申请/专利权人：美国亚德诺半导体公司
摘要：本文描述了用于高速时钟的紧凑八进制相位生成的多相位时钟发生器实施方案。多相位时钟发生器可以包括输出具有四进制相位的中间时钟信号的同相和正交IQ时钟发生器和生成输出时钟信号的八进制相位发生器，所述输出时钟信号包括一个或多个八进制相位并且具有与到所述多相位时钟发生器的输入两相时钟信号相同的时钟频率。所述多相位时钟发生器可以包括下拉电路和电流偏置电路，其可以用于提高所述八进制相位发生器的相位插值线性度。相移误差比较的直方图显示了多相位时钟发生器实施方案相对于常规相位插值的显著改善。
主权项：1.一种多相位时钟发生器，包括：四进制相位时钟发生器，所述四进制相位时钟发生器接收具有两个相反时钟相位的两相时钟信号并且生成包括一个或多个四进制相位的中间时钟信号；和八进制相位发生器，所述八进制相位发生器接收所述中间时钟信号以生成包括一个或多个八进制相位的输出时钟信号，所述八进制相位发生器包括一个或多个八进制相位单元，其中每个八进制相位单元包括第一逻辑门分支和第二逻辑门分支，所述第一逻辑门分支和所述第二逻辑门分支分别被配置为接收所述中间时钟信号的第一四进制相位和第二四进制相位，其中所述第一逻辑门分支和所述第二逻辑门分支被桥接以生成八进制相位，所述八进制相位具有作为所述第一四进制相位和所述第二四进制相位的平均值的相移。
全文数据：
权利要求：
百度查询： 美国亚德诺半导体公司 用于相位插值器应用的紧凑和高速的八进制时钟相位发生器
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