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申请/专利权人：爱思开海力士有限公司
摘要：一种半导体装置包括内部时钟生成电路和数据处理电路。内部时钟生成电路使通过对时钟信号进行分频而生成的第一分频时钟信号至第四分频时钟信号延迟基于第一码信号和第二码信号而调整的延迟时间以生成第一内部时钟信号至第四内部时钟信号。数据处理电路与第一内部时钟信号至第四内部时钟信号同步地对准内部数据以生成输出数据。数据处理电路还根据读取命令被输入的时间点基于第一命令阻挡信号和第二命令阻挡信号中断输出数据的生成。
主权项：1.一种半导体装置，包括：内部时钟生成电路，被配置成将通过对时钟信号进行分频而生成的第一分频时钟信号至第四分频时钟信号延迟基于第一码信号和第二码信号而调整的延迟时间以生成第一内部时钟信号至第四内部时钟信号；以及数据处理电路，被配置成与所述第一内部时钟信号至第四内部时钟信号同步地对准内部数据以生成输出数据，以及被配置成根据读取命令被输入的时间点基于第一命令阻挡信号和第二命令阻挡信号而中断所述输出数据的生成，以及其中，所述数据处理电路被配置为根据所述第一命令阻挡信号和第二命令阻挡信号输出具有恒定电平的输出数据。
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权利要求：
百度查询： 爱思开海力士有限公司 半导体装置和半导体系统
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