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龙图腾网恭喜深圳比特微电子科技有限公司申请的专利时钟树、用于执行哈希算法的电路、计算芯片、算力板和计算设备获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN111651402B 。

龙图腾网通过国家知识产权局官网在2025-03-11发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202010687806.8，技术领域涉及：G06F15/78；该发明授权时钟树、用于执行哈希算法的电路、计算芯片、算力板和计算设备是由薛可;范志军;许超;杨作兴设计研发完成，并于2020-07-16向国家知识产权局提交的专利申请。

本时钟树、用于执行哈希算法的电路、计算芯片、算力板和计算设备在说明书摘要公布了：本公开涉及一种时钟树、用于执行哈希算法的电路、计算芯片、算力板和计算设备。所述用于执行哈希算法的电路包括：运算模块，被配置为对接收的数据块进行哈希运算，其包括以流水线结构布置的多个运算级以使得基于数据块的数字信号沿着多个运算级依次传递，每个运算级包括多个寄存器和组合逻辑模块，第一组寄存器的输出端至少耦接到当前运算级的组合逻辑模块的输入端，第二组寄存器的输入端耦接到前一运算级的组合逻辑模块的输出端；和时钟模块，被配置为向每一个运算级提供时钟信号，时钟模块包括多级时钟驱动电路以使得来自于时钟源的时钟信号沿着多级时钟驱动电路依次传递，其中对于第一组寄存器和第二组寄存器，数字信号的传递方向与所述时钟信号的传递方向相同。

本发明授权时钟树、用于执行哈希算法的电路、计算芯片、算力板和计算设备在权利要求书中公布了：1.一种用于执行哈希算法的电路，包括：输入模块，被配置为接收数据块；运算模块，被配置为对接收的数据块进行哈希运算，所述运算模块包括以流水线结构布置的多个运算级以使得基于所述数据块的数字信号沿着所述多个运算级依次传递，所述多个运算级中的每个运算级包括多个寄存器和组合逻辑模块，其中在每一当前运算级中，所述多个寄存器中的第一组寄存器的输出端至少耦接到当前运算级的组合逻辑模块的输入端，并且所述多个寄存器中的第二组寄存器的输入端耦接到前一运算级的组合逻辑模块的输出端；和时钟模块，被配置为向所述多个运算级的每一个运算级提供时钟信号，所述时钟模块包括多级时钟驱动电路以使得来自于时钟源的时钟信号沿着所述多级时钟驱动电路依次传递，其中对于所述多个运算级的所述第一组寄存器和所述第二组寄存器，所述数字信号的传递方向与所述时钟信号的传递方向相同。

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