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龙图腾网恭喜艾尔默斯半导体欧洲股份公司申请的专利用于产生高频时钟的设备获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN118677458B 。

龙图腾网通过国家知识产权局官网在2025-05-13发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202410826887.3，技术领域涉及：H03L7/099；该发明授权用于产生高频时钟的设备是由约尔格·克鲁帕;托马斯·恩格尔曼设计研发完成，并于2023-06-29向国家知识产权局提交的专利申请。

本用于产生高频时钟的设备在说明书摘要公布了：本发明涉及用于产生高频时钟303的设备，其包括控制器311、第一FLL或PLL调控环323、固定频率基准时钟振荡器1101、输入信号308、分频器比率计算器1110和测量设备509。第一FLL或PLL调控环323具有第一分频器520。固定频率基准时钟振荡器1101产生基准时钟306。测量设备509测量输入信号308中偶尔出现的基准信号并确定相关的有效测量值517。分频器520将高频时钟303以分频比向分频为分频高频时钟521的频率并以第二分频比向分频为辅助时钟1112。分频器比率计算器1110确定辅助时钟1112的测量值并将有效测量值517与辅助时钟1112的测量值比较，并由此确定反映测量值517与辅助时钟1112的测量值之间的比率和或差值的比率值。分频器比率计算器1110根据该偏差改变第一分频器520的目标分频比1111。

本发明授权用于产生高频时钟的设备在权利要求书中公布了：1.一种用于产生高频时钟303的设备，其中，所述设备包括控制器311，并且其中，所述设备包括第一FLL或PLL调控环323，并且其中，所述设备包括第二FLL或PLL调控环324，并且其中，所述设备包括输入信号308，并且其中，基准信号作为所述输入信号308的一部分间歇地出现，并且其中，所述第二FLL或PLL调控环324被配置为当所述第二FLL或PLL调控环324启用时，根据作为所述第二FLL或PLL调控环324的目标信号的所述输入信号308的一个或多个所述基准信号来产生基准时钟306，并且其中，所述第二FLL或PLL调控环324被配置为当所述第二FLL或PLL调控环324停用时，根据取决于一个或多个有效基准信号的测量值的状态，产生作为所述第二FLL或PLL调控环324的目标信号的所述基准时钟306，并且其中，所述第一FLL或PLL调控环323被配置为当所述第一FLL或PLL调控环323启用时，根据用作所述第一FLL或PLL调控环323的目标信号的所述基准时钟306产生高频时钟303，并且其中，所述第一FLL或PLL调控环323被配置为当所述第一FLL或PLL调控环323停用时，根据在所述第一FLL或PLL调控环323的最近启用状态下的所述基准时钟306的状态，继续产生作为所述第一FLL或PLL调控环323的目标信号的所述高频时钟303，并且其中，所述高频时钟303的频率在数值上大于所述基准时钟306的频率，或者其中，所述高频时钟303的周期时长在数值上小于所述基准时钟306的周期时长，并且其中，所述控制器311被配置为在设备300的正常状态400中，通过所述控制器311的第二启用停用信号325停用所述第二FLL或PLL调控环324，并且其中，所述控制器311被配置为在设备300的所述正常状态400中，通过所述控制器311的第一启用停用信号313启用所述第一FLL或PLL调控环323，并且其中，所述控制器311被配置为在所述正常状态400中，检测所述输入信号308的一个或多个所述基准信号的来临，或者预期到所述输入信号308的一个或多个所述基准信号在预定时间的来临或被所述第二FLL或PLL调控环324的设备部件通知所述输入信号308的一个或多个所述基准信号的来临，并且其中，所述控制器311和或所述第二FLL或PLL调控环324的设备部件被配置为在测量所述输入信号308的同步信号的状态403中，测量所述输入信号308中的用作所述同步信号的所述基准信号并评估所述基准信号，并且确定所述输入信号308中的用作所述同步信号的所述基准信号的参数的值，并且其中，所述控制器311被配置为随后启用所述第二FLL或PLL调控环324，并且使所述第二FLL或PLL调控环324进入到校正所述基准时钟306的频率或周期时长或相位的状态406，使得所述第二FLL或PLL调控环324调控所述基准时钟306的相应参数，直到所述基准时钟306的所述相应参数对应于所述输入信号308中的用作所述同步信号的一个或多个所述基准信号的所述参数的确定值或从其推导出的值，并且其中，所述控制器311被配置为一旦所述基准时钟306的所述相应参数的值对应于所述输入信号308中的用作所述同步信号的所述基准信号的所述参数的确定值或从中推导出的值，则随后停用所述第二FLL或PLL调控环324，并且因而使所述第二FLL或PLL调控环324返回到所述正常状态400。

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