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【发明公布】用于估计PLD设计中的信号相关延迟的方法和装置_微芯片技术股份有限公司_202280021234.7 

申请/专利权人:微芯片技术股份有限公司

申请日:2022-05-11

公开(公告)日:2023-11-17

公开(公告)号:CN117083615A

主分类号:G06F30/367

分类号:G06F30/367

优先权:["20210518 US 63/190,237","20220510 US 17/740,644"]

专利状态码:在审-实质审查的生效

法律状态:2023.12.05#实质审查的生效;2023.11.17#公开

摘要:公开了一种用于估计PLD设计中的信号相关延迟的方法和装置。关于一个或多个级对该PLD设计建模,该级中的每一者包括驱动器和用布线树耦接到该驱动器的一个或多个接收器。该建模基于一组选定参数,该一组选定参数包括:与该驱动器相关联的斜率相关延迟;与该布线树的布局相关的延迟;与来自先前驱动器输入的斜率传递相关的参数。访问该选定参数中的每个选定参数的一组预定值;计算用于经建模的级中的每一者的该估计的信号相关延迟;并且被写入到计算机可读存储介质。

主权项:1.一种用于估计可编程逻辑器件PLD设计中的信号相关延迟的方法,所述方法包括:关于一个或多个级对PLD设计建模,所述级分别包括驱动器和用布线树耦接到所述驱动器的一个或多个接收器,所述建模基于一组选定参数所述一组选定参数包括:与所述驱动器相关联的一个或多个斜率相关延迟;与所述布线树的布局相关的延迟;和与来自先前驱动器输入的斜率传递相关的参数,所述先前驱动器在所述驱动器上游相继按顺序与所述一个或多个级相关;从第一计算机可读存储介质访问经建模的级的所述选定参数的一组预定值;基于对应的访问的选定参数值之和计算用于经建模的级的估计的信号相关延迟;以及在第二计算机可读存储介质中写入所计算的用于经建模的级的估计的信号相关延迟。

全文数据:

权利要求:

百度查询: 微芯片技术股份有限公司 用于估计PLD设计中的信号相关延迟的方法和装置

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