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申请/专利权人：英特尔公司
申请日：2021-12-17
公开（公告）日：2024-04-19
公开（公告）号：CN117908795A
主分类号：G06F3/06
分类号：G06F3/06
优先权：["20201223 US 17/133,570"]
专利状态码：在审-实质审查的生效
法律状态：2024.05.07#实质审查的生效;2024.04.19#公开
摘要：本申请公开了具有元数据位的64位虚拟地址和不会由于元数据位的非规范值而失败的规范性检查。描述了允许在虚拟地址中未使用的位中使用元数据的技术。一方面，处理器包括用于对存储器访问指令解码的解码电路。指令指示具有地址生成信息和元数据的一个或多个存储器地址操作数。与解码电路耦合的执行电路基于该一个或多个存储器地址操作数生成64位虚拟地址。64位虚拟地址具有位63、开始于位0的存储从地址生成信息生成的地址的X位地址字段、以及存储元数据的一个或多个元数据位。执行电路还对64位虚拟地址执行不会由于该一个或多个元数据位中所存储的元数据的非规范值而失败的规范性检查。公开了其他处理器、方法、系统和指令。
主权项：1.一种处理器，包括：型号专属寄存器MSR，具有用于存储第一位值的位位置；代码段CS寄存器，具有用于存储第二位值的第二位位置；以及电路系统，用于对虚拟地址执行规范性检查，所述虚拟地址具有位位置56:0来存储地址，其中，如果所述第一位值和所述第二位值被设置成二进制1，第三位值被设置为二进制1，并且所述虚拟地址被用于数据访问，则对所述虚拟地址的所述规范性检查将不会由于所述虚拟地址的位位置62:57中存储的位是非规范的而失败。
全文数据：
权利要求：
百度查询： 英特尔公司 具有元数据位的64位虚拟地址和不会由于元数据位的非规范值而失败的规范性检查
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