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申请/专利权人：西安爱生技术集团有限公司
摘要：本公开实施例是关于一种基于FPGA的CML接口协议编码系统及方法。该系统包括：FPGA协议编码器模块和FPGA高速收发器接口本公开数据缓存子模块用于数据存储和速率匹配，协议预处理子模块对控制信号进行初步的分类，协议控制子模块按照接口协议控制规则将控制信号编码成控制字符，8B10B编码子模块完成控制字符和数据字符的8B10编码，RD极性计算子模块实时计算编码后数据帧的RD极性，供8B10B编码子模块及协议控制子模块使用满足编码中对极性的要求。FPGA高速收发器接口采用电流型逻辑电路模式，使用差分信号对数据进行传输。
主权项：1.一种基于FPGA的CML接口协议编码系统，其特征在于，该系统包括：FPGA协议编码器模块和FPGA高速收发器接口；其中，所述FPGA协议编码器模块包括数据缓存子模块、协议预处理子模块、协议控制子模块、RD极性计算子模块和8B10B编码子模块，所述数据缓存子模块的发送端分别与所述协议预处理子模块的接收端和所述8B10B编码子模块的接收端连接，所述协议预处理子模块的发送端与所述协议控制子模块的接收端连接，所述协议控制子模块的发送端与所述8B10B编码子模块的接收端连接，所述RD极性计算子模块和所述8B10B编码子模块交互连接，所述RD极性计算子模块的发送端与所述协议控制子模块的接收端连接，所述8B10B编码子模块的发送端与所述FPGA高速收发器接口的接收端连接。
全文数据：
权利要求：
百度查询： 西安爱生技术集团有限公司 一种基于FPGA的CML接口协议编码系统及方法
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