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申请/专利权人：德克萨斯仪器股份有限公司
申请日：2018-02-11
公开（公告）日：2024-05-31
公开（公告）号：CN118113351A
主分类号：G06F9/30
分类号：G06F9/30
优先权：["20170220 US 15/437,253"]
专利状态码：在审-实质审查的生效
法律状态：2024.06.18#实质审查的生效;2024.05.31#公开
摘要：本申请公开一种用于缩减面积的控制寄存器电路的方法与装置。在所描述的示例中，一种装置图2，241包括：包含用于控制电路系统的控制位的一组控制寄存器231，其被耦合以接收寄存器写入使能信号WE0‑WE511并接收输入数据；用于存储与控制位对应的数据的存储器213，其被耦合以接收地址和存储器写入使能信号；解码电路系统207，其被耦合以输出寄存器写入使能信号WE0‑WE511；数据输出总线，其被耦合以从存储器接收数据但不连接到控制寄存器；以及控制器215，其被耦合以接收地址、被耦合以在内部地址总线上输出地址、被耦合以输出写入使能信号并且被耦合以输出存储器写入使能信号，控制器被配置为促使数据被写入到与所接收的地址对应的所选择的控制寄存器，并促使数据同时被存储在与所接收的地址对应的存储器位置处。
主权项：1.一种电路器件，其包括：控制器，其包括：一组数据输入端，其用于接受第一组数据；一组寄存器数据输出端，其用于基于所述第一组数据来提供寄存器数据；和一组存储器数据输出端，其用于基于所述第一组数据来提供存储器数据；耦合到所述控制器的一组控制寄存器，其中所述一组控制寄存器中的每个寄存器包括：一组数据输入端，其耦合到所述控制器的所述一组寄存器数据输出端；和一组数据输出端；耦合到所述控制器的存储器，其包括：一组数据输入端，其耦合到所述控制器的所述一组存储器数据输出端；和一组数据输出端，其耦合到所述控制器的所述一组数据输入端；以及误差检测电路，其耦合到所述一组控制寄存器和所述存储器，所述误差检测电路被配置为生成误差输出；其中响应于所述误差检测电路的所述误差输出指示误差，所述控制器被配置为将所述第一组数据存储在所述一组控制寄存器的第一寄存器中和所述存储器的第一存储器位置中，所述第一存储器位置对应于所述第一寄存器。
全文数据：
权利要求：
百度查询： 德克萨斯仪器股份有限公司 用于缩减面积的控制寄存器电路的方法与装置
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