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申请/专利权人：西安工程大学
摘要：本发明公开了一种具有优化相位噪声的锁相环系统，包括构成一个闭环系统的时间数字转换器、数字环路滤波器、数模转换器、压控振荡器以及分频器；时间数字转换器的一个输入基准信号是R、另一个输入信号是D，时间数字转换器的输出信号DI为数字环路滤波器的输入信号，数字环路滤波器的输出信号FDI为数模转换器的输入信号，数模转换器的输出信号VI为压控振荡器的输入信号，压控振荡器的输出信号P为分频器的输入信号，分频器的输出信号为时间数字转换器的另一个输入信号D。本发明利用数模转换器级联压控振荡器代替数控振荡器降低相位噪声，利用高精度的时间数字转换器和精度较高的数模转换器改善相位噪声。
主权项：1.一种具有优化相位噪声的锁相环系统，其特征在于，包括构成一个闭环系统的时间数字转换器、数字环路滤波器、数模转换器、压控振荡器以及分频器；其中：所述时间数字转换器的一个输入基准信号是R、另一个输入信号是D，所述时间数字转换器的输出信号DI为数字环路滤波器的输入信号，所述数字环路滤波器的输出信号FDI为数模转换器的输入信号，所述数模转换器的输出信号VI为压控振荡器的输入信号，所述压控振荡器的输出信号P为分频器的输入信号，所述分频器的输出信号为时间数字转换器的另一个输入信号D；所述时间数字转换器用于鉴别输入基准信号R和分频器输出信号的频率和相位，所述时间数字转换器包含预处理逻辑、延时链和计数器；所述预处理逻辑的电路包含对称缓冲器链、判决器和选通器，其中：R和D作为对称缓冲器链的输入信号，分别通过两路对称的缓冲器链得到时序超前的信号F1和时序滞后的信号S1，F1和S1作为判决器的输入信号，判决器根据F1和S1的时序快慢，输出判定电平信号E，当E为0时，F1为R，S1为D；当E为1时，F1为D，S1为R，E作为选通器的输入信号，根据E的电平来控制选通器的导通或关断，并产生输出信号S2和F2，信号S1和信号S2均为滞后信号，F1和F2均为超前信号，即当E为0时，F2为R，S2为D；当E为1时，F2为D，S2为R。
全文数据：
权利要求：
百度查询： 西安工程大学 一种具有优化相位噪声的锁相环系统
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