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申请/专利权人：西安智多晶微电子有限公司

摘要：本发明涉及一种多路PWM的实现方法和系统，该方法基于FPGA器件实现包括：根据用户配置的PWM参数，生成第一时钟和第二时钟，PWM参数包括PWM级数，第一时钟的频率高于第二时钟的频率；将PWM级数划分为整数部分和小数部分；根据整数部分在第二时钟下进行循环计数，得到计数值；根据接收的至少一个起止点位置信息，生成至少一路PWM信号；其中，每一路PWM信号的生成过程包括：根据接收的起止点位置信息和计数值，生成PWM信号的并行输入数据；在第二时钟下对并行输入数据进行并串转换，在第一时钟的双边沿输出转换后的串行输出数据，得到PWM信号。本发明能够实现多路PWM信号的动态调整，调整精度可达到1ns或更高。

主权项：1.一种多路PWM的实现方法，其特征在于，基于FPGA器件实现，所述方法包括：根据用户配置的PWM参数，生成第一时钟和第二时钟，所述PWM参数包括PWM级数，所述第一时钟的频率高于所述第二时钟的频率；将所述PWM级数划分为整数部分和小数部分，包括：根据分频参数对所述PWM级数进行划分，得到整数部分的位宽和小数部分的位宽；所述分频参数根据PWM最小精度自动适配得到；根据所述整数部分在所述第二时钟下进行循环计数，得到计数值；根据接收的至少一个起止点位置信息，生成至少一路PWM信号；其中，每一路PWM信号的生成过程包括：根据接收的所述起止点位置信息和所述计数值，生成所述PWM信号的并行输入数据；在所述第二时钟下对所述并行输入数据进行并串转换，在所述第一时钟的双边沿输出转换后的串行输出数据，得到所述PWM信号；其中，根据接收的所述起止点位置信息和所述计数值，生成所述PWM信号的并行输入数据，包括：根据接收的所述起止点位置信息，确定所述用户配置的所述PWM信号在周期内的起点位置和终点位置；根据所述PWM级数划分的整数部分和小数部分，得到所述起点位置的起点整数部分和起点小数部分，以及所述终点位置的终点整数部分和终点小数部分；利用预设的第一查找表对所述起点小数部分进行映射查找，得到第一数据序列，利用预设的第二查找表对所述终点小数部分进行映射查找，得到第二数据序列，所述第一数据序列和所述第二数据序列均为2*Nbit的数据序列，N为分频参数；根据所述计数值生成对应的连续2*Nbit并行数据作为所述PWM信号的并行输入数据，其中，如果所述起点整数部分和所述终点整数部分不重合，所述第一数据序列赋值在所述计数值中所述起点整数部分的对应位置，所述第二数据序列赋值在所述计数值中所述终点整数部分的对应位置，所述第一数据序列与所述第二数据序列之间均为1，除所述起点整数部分与所述终点整数部分之间、所述起点整数部分以及所述终点整数部分之外的计数值对应位置均为0；如果所述起点整数部分和所述终点整数部分重合，对所述第一数据序列和所述第二数据序列进行逻辑与运算，逻辑与运算结果赋值在所述计数值中所述起点整数部分的对应位置，除所述起点整数部分之外的计数值对应位置均为0。

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