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申请/专利权人：上海星思半导体有限责任公司
摘要：本申请提供了一种用于DDR的跨时钟域电路、物理接口收发器与通信系统。该跨时钟域电路包括第一FIFO模块、第二FIFO模块和合并模块。其中，第一FIFO模块，用于工作在DDR时钟的上升沿触发模式；第二FIFO模块，用于工作在DDR时钟的下降沿触发模式；合并模块，用于对第一FIFO模块和第二FIFO模块的输出数据进行合并。本方案中通过在接收路上设置双FIFO模块来处理DDR数据，使得单FIFO模块的主频得到降低，保证了物理接口收发器的整体的功耗较低，以及提升了吞吐率，从而解决了现有技术中高吞吐量的DDR跨时钟域的功耗较高的技术问题，进而能够较好地满足高吞吐的LPDDR的需求。
主权项：1.一种用于DDR的跨时钟域电路，其特征在于，包括：第一FIFO模块，用于工作在DDR时钟的上升沿触发模式；第二FIFO模块，用于工作在所述DDR时钟的下降沿触发模式；合并模块，用于对所述第一FIFO模块和所述第二FIFO模块的输出数据进行合并。
全文数据：
权利要求：
百度查询： 上海星思半导体有限责任公司 用于DDR的跨时钟域电路、物理接口收发器与通信系统
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