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申请/专利权人：中国科学院光电技术研究所
摘要：本发明公开了一种利用串扰电压延展脉冲宽度的时间数字转换器设计方法，通过在脉冲信号上升沿阶段叠加反向串扰电压，改变脉冲切换逻辑所需的电压幅值，实现脉冲信号的脉宽延展。本发明巧妙地将串扰电压转化成了一种正面效应，通过时序同步设计，利用信号链路中继，实现了可控的信号脉宽现场调制，有效降低了时间数字转换器电路对ASIC流片的依赖。
主权项：1.一种利用串扰电压延展脉冲宽度的时间数字转换器设计方法，其特征在于，所述方法包括如下步骤：步骤1、利用FPGA器件逻辑模块中的MUX器件，构建不改变输入信号脉宽的逻辑‘或’门；步骤2、基于FPGA导轨二维矩阵结构，选取四组依次连接并两两垂直的导轨，在每一组导轨内选取两条平行导线构建一组传输线对，利用四组传输线对构建两个相互嵌套矩形脉冲循环电路，所述嵌套矩形脉冲循环电路包括：由每组传输线对中一条导线通过开关盒结构相互连接所构成的内层矩形脉冲循环电路，以及每组传输线对中另一条导线通过开关盒结构相互连接所构成的外层矩形脉冲循环电路；步骤3、利用FPGA的开关盒将待测脉冲信号复制为第一待测脉冲信号、第二待测脉冲信号，并利用步骤1所述的逻辑‘或’门分别导入内层矩形脉冲循环电路、外层矩形脉冲循环电路，其中，第一待测脉冲信号、第二待测脉冲信号同时从内层矩形脉冲循环电路、外层矩形脉冲循环电路的同一侧对角线顶点出发，分别沿各自矩形脉冲循环电路的侧边逆时针方向、顺时针方向自由传输，在经历相同延迟后，第一待测脉冲信号、第二待测脉冲信号于另一侧对角线顶点处汇合，并产生对应的第一串扰电压、第二串扰电压；步骤4、配置内层矩形脉冲循环电路、外层矩形脉冲循环电路间的平行导线耦合长度，使得第一串扰电压仅作用于第二待测脉冲的上升沿；步骤5、通过人工布线，强制第一待测脉冲信号、第二待测脉冲信号在汇合点处绕道进入可编程逻辑块，以让信号经过中继器，执行逻辑切换。
全文数据：
权利要求：
百度查询： 中国科学院光电技术研究所 利用串扰电压延展脉冲宽度的时间数字转换器设计方法
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